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[参考译文] RTOS/TMS320C6657:设计问题:通过 EMIF 将数据传输到外部 FIFO

Guru**** 2555630 points
Other Parts Discussed in Thread: SN74V245, SN74AVC16T245

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/624382/rtos-tms320c6657-design-question-data-transfer-to-external-fifo-through-emif

器件型号:TMS320C6657
主题中讨论的其他器件:SN74AVC16T245SN74V245TMS320C6201

工具/软件:TI-RTOS

你好

我想征求有关设计的建议。 问题包含一些软件元素和一些硬件元素。

其理念是与外部 FIFO 之间传输数据、如中所述

 。 当然、通过电压转换器(例如 sn74avc16t245)连接到 FIFO (sn74v245)会成功、但我认为这不会是问题。 我的具体问题是:

该文档是为 TMS320系列编写的、提供了与6201相关的示例。 它对6657也有效吗? 或者、我应该阅读哪些文档?

1 -该文档提到 EDMA 传输是可能的。 实际上是否可以使用 EDMA 传输? 我之所以提出这个问题、是因为我无法了解我需要连接哪些 DSP 引脚、或者我如何设置 EMIF 以在 EDMA 传输期间生成/接受正确的事件。

2 -我应该考虑改用 uPP 接口吗?

3 -类似硬件上是否有任何示例可用作参考或起点?

非常感谢 Advace!

此致、

Pablo

电源 我刚尝试粘贴文档的 URL、它成功了、但几秒钟后、出现了一个大矩形。 希望您收到可读的消息。

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    您好、Pablo、

    我已将您的疑问转发给专家。 他们的反馈应发布在此处。

    BR
    Tsvetolin Shulev
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    您好、Pablo、

    从硬件的角度来看、EDMA 的使用不应与单独访问的使用有所不同。 它将根据您配置 EMIF 时序的方式生成一个访问字符串。 您参考的文档似乎显示了与 FIFO 的可用连接、但您需要检查所有时序、以确保两个器件都满足设置和保持时间。 uPP 与 EMIF 的选择在很大程度上取决于所需的数据吞吐量。 许多文章讨论了 EMIF 接口的吞吐量限制。 UPP 可提供更高的吞吐量、但设计中更难使用的接口。 遗憾的是、我们没有任何示例设计将 uPP 或 EMIF 连接到我可以提供的 FIFO。

    此致、

    Bill

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    您好 Bill

    感谢您的回答。 我想我将坚持使用 EDMA、并检查时序。 我"相信"我有这方面的信息。 之所以出现引号、是因为数据表的修订版 B 中给出了 DSP-6657-EMIF16的时序、而修订版 C 中没有这些时序

    还有一些我不太理解的问题:

    假设我要通过 EMIF16将数据输出到 FIFO。 然后、在特定时刻、我希望 DSP 在某些新数据准备好发送到 FIFO 时生成输出信号(例如、上升沿)。 但是、当我阅读评估板 TMDSEVM6657L 的文档时、我看到这些控制引脚(例如 DSP_EMIFOEZ、DSP_EMIFWEZ、DSP_EMIFNW)只为"输入"。 我是不是很基本、就是评估板的局限性? 在第一种情况下、我可能必须为 FIFO 和 DSP 设置同步机制、以某种方式应该注意到 EDMA 活动或与其同步。 在后一种情况下、我可以从 EDMA 活动产生的信号中挂钩、这些信号是什么?

    对我来说同样困惑的是、EMIFA[23:0]和 CE[3:0]也只是"输入"。 我开始想我在这里看到了一些非常基本的东西。 我们将非常感谢您提供的任何建议。

    非常感谢您的参与。

    此致、

    Pablo

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    您好、Pablo、
    原理图中调试接头上显示的方向与插入该连接器的电路板相关。 地址和命令信号是调试板的输入。
    此致、
    Bill
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    您好 Bill

    感谢您的快速回答。 我认为这意味着评估板的文档只提到一种可能的使用(调试板)、而其他使用可能会充分利用潜力。 如果我在崇拜、请纠正我的错误。

    请您向我介绍6657上哪些引脚用于 TMS320C6201的异步存储器控制的文档吗? 我提出这个问题 是因为这是我在原始问题中提到的文档中提到的 DSP,它广泛使用了这些是/awe 信号(如的第8页所示  )。

    很抱歉、我对这些概念的理解有点慢、但我仍然想了解我应该连接哪些引脚。 在您的第一个回答中、您说可以使用 EDMA、并且有较旧的文章指出了这一点、仅此而已、但在文档中找不到建议详细信息。 如果我进行单独访问、当然可以提供同步信号、但整个过程会太慢。 如果我去 EDMA、那么我需要 DSP 侧的一些硬件支持、这些支持可以连接到 FIFO 的 RCLK/WCLK。 但我没有找到确切的信息。 请给我指出文档吗?

    即使我想 EDMA -> EMIF 传输只有一个字、我也需要向 FIFO 发送信号以接受字_after_、该字已在 EMIF 引脚上提供。 我可能会问一些您认为显而易见的简单问题。

    此致、

    Pablo

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    您好、Pablo、
    随附文档的第34页显示了 C6201的异步存储器访问。 您可以将其与 RevC C6657数据表第54页的图表进行比较。 请记住、EMIF 接口是高度可编程的、因此您将能够更改一些时序参数。 如需更多信息、我建议您查看用于 KeyStone 器件的外部存储器接口(EMIF16)用户指南。

    您会发现 C6201上的是和 AWE 对应于 EMIFOE 和 EMIFWE。 (这些在图中被称为 EM_OE 和 EM_WE。 这在要更正的队列中。) EMIF16接口中不存在与 AOE 等效的接口。 当 EMIFCEx 为低电平且 EMIFW 为高电平时、您必须使用一些外部逻辑来创建 AOE 信号。

    无论它是 EDMA 还是单次访问、EMIF 都将为每个16位访问生成时序图中显示的信号(如果您以这种方式对其进行编程、则为8位访问生成信号)。 FIFO 使用 RCLK 为数据输入计时、或使用 WCLK 为数据输出计时。 您正在使用 OE、我们通过信号为数据计时。 OE 的上升沿将数据时钟移入 FIFO、而我们的上升沿将数据时钟输出 FIFO。 只要不违反设置和保持时间、就应该可以这样做。

    不要在 EDMA 方面挂断电话。 EDMA 只是一种在没有处理器干预的情况下将大块从存储器移动到 EMIF 接口的方法。 在器件外部、这些访问看起来都是一样的。

    此致、
    Bill
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    感谢 Bill 提供了非常详细的回答。 我已经花了几个小时在你提到的文件上,但我无法将6201图中的 R/AWE 与6657的 EMIFOE/EMIFWE 联系起来。 这些信息对我了解该机制至关重要。