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[参考译文] AM5728:McASP[3:1]上的 FIFO 不可用

Guru**** 2560320 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/612224/am5728-fifo-not-available-on-mcasp-3-1

器件型号:AM5728

你好!

阅读 AM57xx 参考手册(修订版 I)-我在第6165页找到以下注意事项:

"McASP1、McASP2和 McASP3、它们的数据端口可通过 L3_main 直接访问、DO
不支持 FIFO/常量寻址模式。 必须改为使用递增传输。"

数据端口的理念是、我可以使用具有单个地址的 FIFO 访问串行器。

由于数据端口上没有其他寄存器-在它上执行传输的符号将是我所不包括的。

这基本上意味着通过 L3_main 的数据端口不起作用!!???

因此、唯一的方法是将 EDMA 与不带 FIFO 的 CFG 端口一起使用。

在我的情况下(只有一个通道)、这仍然是一个不递增的访问。

或者在数据端口位置是否有未记录的串行器"影子"地址!??

Rgds、

Wolfgang

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    工厂团队已收到通知。 他们将在这里作出回应。
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    对于通过 McASP_DAT 地址范围访问 McASP FIFO 的情况、不  使用地址总线的最低有效位。  例如、对于 McASP2、只要 EDMA 事务保持在0x45Cx_xxxx 的4MB 地址范围内、就会访问 FIFO 的头/尾。  这样、您就可以使用 EDMA 的"递增"模式、并且仍然可以访问 McASP FIFO。

    Ch2中的 L3_MAIN 存储器映射显示了完整范围:

    此致、
    Kyle

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    您好、Kyle、

    所以,在 L3_main 或类似的地方,McASP 和 EDMA 之间存在同步问题?

    今天、我尝试 使用 dsp1存储器写入操作 fifo 至 McASP1_DAT 地址(无增量)。

    非常好的工作方式-

    我可以使用44.1kHz 全双工从1ms 任务运行 McASP、而不会出现任何问题。

    您是否知道访问 RX/TXBUF (DATA)和 FIFO 状态涉及哪些延迟/等待状态?

    在某些设置中-将 FIFO 中的 DSP 填充可能是一个有趣的选择、...

    Rgds。

    Wolfgang

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    (笑声) 或者、如果这是一种所需的行为、则应在参考手册中对其进行描述。 如果这是勘误表-则应在勘误表中进行说明。 不描述问题并指出模糊解决方案的注释是一个问题。
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    沃尔夫冈

    "问题"不是重复访问同一地址。  相反、当 CPU 或 DMA 发出"突发"时、问题与 SoC 的内部总线协议有关。  

    通常情况下、突发信号由单个地址发出、且突发类型设置为"增量"。  这是 McASP1/2/3目标的 L3端口支持的唯一模式。

    当 DSP 访问 McASP 时、它使用带有"递增"标志的单字读取/写入(但由于它是单字、"递增"概念无关紧要)。

    当 EDMA 访问 McASP 时、您可以将 AMODE 设置为递增或 CONST/FIFO。  当发出 CONST/FIFO 突发时、协议旨在重复访问同一字位置。  由于未在该 L3端口上启用此功能,因此您应该使用递增,并且由于 ls 地址位递增仍会访问 FIFO ... 它的工作原理。

    此致
    Kyle