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[参考译文] 66AK2L06:使用66AK2L06访问 DDR3 RAM

Guru**** 2609895 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/648358/66ak2l06-ddr3-ram-access-with-66ak2l06

器件型号:66AK2L06

您好!

我们目前正在评估使用66AK2L06作为后端平台的升级版。
从数据表(第4页)中、似乎无法直接从所有处理单元(即 ARM A15、C66x、FFTC 等)访问外部 DDR3 RAM、但需要通过2MB MSM/SRAM 进行传输。 我对 Block Diagramm 的理解是否正确?

在我们的应用中、我们将通过 JESD 向 DDR3 RAM 采样大约192MB 的数据、并希望在不同时间对具有不同内核的数据应用不同的数据处理步骤。 因此、所有处理单元都需要通过 DMA 访问 DDR3 RAM 中的数据。 有可能吗?

感谢您的帮助。

此致、

Tom

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好、Tom、

    很抱歉耽误你的时间。 是的、DDR 可用于所有内核和外设。 最好将数据流从接收映射到您需要使用的各种存储器和外设。 由于有多个 DMA 域(主要是多核导航器和 EDMA)、DDR 延迟的影响通常可以消除、因为 DMA 可以在后台将数据预取至外设存储器或延迟更低的 RAM。

    例如、有一个导航器循环将 DDR 描述符(内存块)复制到 L2描述符、而外设正在使用已复制的 L2描述符。

    通常情况下、ARM 内核使用存储器的虚拟映射、而 DSP 内核使用物理地址。 多核导航器确实需要使用物理地址、这需要在 QMSS LLD 驱动程序中进行地址转换。