[参考译文] TMDSLCDK6748：查找硬件原理图中的引脚！

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/652983/tmdslcdk6748-finding-the-pinouts-in-the-hardware-schematic

器件型号：TMDSLCDK6748

您好、TI 团队、

我正在尝试使用修订版 A7a 下的硬件原理图文件来查找要使用的外设的引脚排列。

我要使用的外设是 upp。两个通道。 J16和 LCD 外设包含大多数 upp 引脚。但引脚(UPP_CH1_D4；UPP_CH1_D5；UPP_CH1_CLK/GPIO6[11]；

UPP_CH1_START/GPIO6[10]；UPP_CH1_ENABE/GPIO6[9]；UPP_CH1_Wai)似乎通过电阻器连接到3V3和 GND！

其次、我想从 lcdk 驱动 ADC 的时钟(10MHz)、我还发现很难找到我可以使用的可编程时钟引脚、也很难找到它的引脚分配。 (我已经阅读了有关 PLLC 的内容、不知道从哪里开始)。

我担心无法使用 upp、并担心10MHz 高于任何其他并行外设。

有人能帮我解决这些问题吗？

此致

拉巴

8 年多前

0 admin 8 年多前

TI__Guru**** 2606725 points

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从原理图 A7E 可以了解到、这些引脚的路径为：

VPIF_DIN12/UHPI_HD4/UPP_CH1_D4 -> NC
VPIF_DIN13_FIELD/UHPI_HD5/UPP_CH1_D5 -> NC
UHPI_HCTL0/UPP_CH1_CLK/GPIO6[11]-> GPIO6-11 -> R195 -> GND
UHPI_HCNTL1/UPP_CH1_START/GPIO6[10]-> GPIO6-10 -> R196 -> GND
UHPI_HHWIL/UPP_CH1_ENABLE/GPIO6[9]-> GPIO6-9 -> R197 -> GND
UHPI_HRWN/UPP_CH1_WAIT/GPIO6[8]-> GPIO6-8 -> AES850：INT (DNI、未组装)

对于 UPP_CH1_CLK、UPP_CH1_START 和 UPP_CH1_ENABLE、您可以将导线连接到各自的电阻器焊盘(而不是接地侧)。电阻器似乎是电路板 ID 自举、假设您永远不会运行 LCDK 的预构建固件、您可能可以移除此自举。

对于 UPP_CH1_WAIT、您可以将导线飞至 AES850：INT 的焊盘。

对于 UPP_CH1_D4和 UPP_CH1_D5、它们为"无连接"、不会引出至任何可访问焊盘。这可能会破坏您使用 UPP CH1的计划。我不确定是否有任何简单的方法可以连接到这些引脚、因为它们位于芯片底部。如果您幸运、电路板底部可能有一个连接到这些引脚的过孔。

有一个独立于称为 CLKOUT 的外设的时钟输出、该输出是 PLLC0 OBSCLK 的输出。在原理图上：

CLKOUT/UHPI_HDS2n/GPIO6[14]-> R60 -> TP10 (DNI)

这就是我的专长。希望一些专业硬件人员可以发表评论。

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