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[参考译文] AM625:OLDI0_CLK0P/N、无输出

Guru**** 2390755 points
Other Parts Discussed in Thread: AM625

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1193943/am625-oldi0_clk0p-n-no-output

器件型号:AM625

在客户电路板上、不存在 OLDI0_CLK0输出。 但数据引脚具有输出。 测试3块电路板、结果相同、PSDK8.04。

连接面板  OLDI0_CLK0时、如下所示、仅为100mV。

未连接面板时 、OLDI0_CLK0上会出现一些噪声。

OLDI0_A3P/N 上

在 OLDI0_A0P/N 上、信号不如  OLDI0_A3P/N 好、

dts 文件

e2e.ti.com/.../k3_2D00_am625_2D00_sk_2D00_GSK_2D00_chenjianfei.dts

kmsproint  

软件配置是否存在硬件问题? 硬件连接非常简单、只是点对点连接。 请建议如何识别?

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    您好、Tony、

    您的客户是否可以使用最新的 PSDK (8.05)? 我们已对 LVDS 驱动器进行了更改、我建议使用最新的树形结构。

    此致、
    Krunal

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    Krunal、

    AM62x-SK  上运行相同内核和 DT 时有 OLDI0_CLK0输出、 我们是否可以排除软件配置?  

    无论如何、我让客户尝试 PSDK8.05。

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    您好、Tony、

    需要检查的一点是 OLDI PD 控制寄存器 :0x00108700。  如果 位0和位1设置为高电平、则意味着 OLDI 关闭。 此外、请查看文档 https://software-dl.ti.com/processor-sdk-linux/esd/AM62X/08_05_00_21/exports/docs/linux/How_to_Guides/Target/How_to_enable_Microtips_LVDS_Panel_on_AM62_SK_EVM.html?highlight=lvds 中的以下"稳定 AM625 SoC 的 OLDI 信号输出的步骤:" 。  

    此致、
    Krunal

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    Krunal、

    从客户电路板上、带隙按如下方式断电。 它是否与 LVDS 面板相关? 还是驱动程序错误?

    root@am62xx-EVM:~# devmem2 0x00108700 
    /dev/mem 已打开。
    映射到地址0xff97ee4000的内存。
    在地址0x00108700 (0xff97ee4700)上读取:0x00000102

    带隙位清零后。 LVDS 时钟输出正确、时序正确。

    但仅显示静态图像、不会像 DPI 那样更新。 现在仍然可以处理 PSDK8.04、不确定它是否是 SDK 的问题。  

    需要一段时间迁移到 PSDK8.05。

    在 PSDK8.5中、带隙断电尚未固定? 将在 PSDK8.6中更新?

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    您好、Tony、

    感谢您的更新! 我相信它将在 PSDK 6.6中修复、但客户可以更新其内核、信息如下:

    1. 或者,可以将 Linux 内核更新为 CICD 标签: tag: cicd.2022.12.10.19.06.00,然后重新构建。 此标签包含修补补丁()drm/tidss: Add bandgap power control for OLDI LVDS buffers,可在需要时启用带隙电路。

    此致、
    Krunal

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    现在、LVDS 工作正常。

    我为 PSDK8.5添加了 diff 补丁

    e2e.ti.com/.../5700.psdk8_2D00_5_2D00_tidss.patcth

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    Krunal、

    客户希望了解根本原因:

    第一。 从联机用户指南上的说明中、您会听到与特定面板相关的问题吗?

    稳定 AM625 SoC OLDI 信号输出的步骤:

    在内部测试期间、某些  LVDS 面板在屏幕上显示失真输出或没有输出。 该问题与带隙寄存器有关、以下步骤说明了如何解决该问题:

    2。 但在 AM62-SK 上、即使没有连接 LVDS 面板、也可以使用与客户电路板相同的配置探测 LVDS 时钟、但在客户电路板上、是否连接 面板、也没有 LVDS 时钟输出、因此似乎与面板无关。  

    如果它是特定于面板的、面板如何影响 SOC 侧的功率位设置?

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    带隙基准设置 LVDS 输出的共模电压。 未启用带隙基准时、共模电压可能不在正确的工作范围内。  各种面板中的 LVDS 接收器可能或多或少会承受不正确的电压。

    此致、
    Paul

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    [引用 userid="35634" URL"~/support/processors-group/processors/f/processors-forum/1193943/am625-oldi0_clk0p-n-no-output/4514578 #4514578"]带隙基准设置 LVDS 输出的共模电压。 [/报价]

    带隙基准似乎是一个内部信号、我在 TRM 中没有找到它。

    带隙基准有何影响? 带隙基准是否因差分 AM62x 器件或差分基于 AM62x 的 PCBA 而异?  

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    带隙基准是 OLDI LVDS 输出缓冲器用来设置其工作电压的内部精密电压基准。 您无需了解内部电路的工作原理、只需在使用 OLDI 时启用带隙基准即可。 默认情况下、此基准处于关闭状态。

    此致、
    Paul