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https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1315992/am625-am6254-lpddr4-interfacing
大家好！
我使用的是 AM6254ATCGGAALW SoC 的定制板、并将其与 LPDDR4 RAM 芯片连接。 LPDDR4地址总线仅为6位宽、它连接到 soc DDR_A 端口中的前6位、其余未连接。 此连接是否 正确？ LPDDR4 RAM 器件型号为 MT53E1G16D1FW046AITA。
如何处理 SoC 上未使用的地址线？
该配置是否涉及性能？
此致、
保罗·恩沃科。
是的、 在设计电路板的 DDR 部分时、请参阅 DDR 布局指南应用手册：www.ti.com/.../sprad06。 该控制器同时支持 DDR4和 LPDDR4、因此需要使用额外的地址信号。 使用 LPDDR4时、这些额外的地址信号未使用、可以保留为无连接。
詹姆斯
发光、 谢谢你。
