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[参考译文] AM6442:AM6442平台使用 CLANG 编译链时、ICSSG1 port0 port1不起作用

Guru**** 2463330 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1470781/am6442-am6442-platform-icssg1-port0-port1-not-work-when-use-clang-compile-chain

器件型号:AM6442

工具与软件:

操作系统: RTOS
icssg dirver:从 sdk9.0中的 uboot 移植

测试方法:PHY 内部环回

编译链:
使用 gcc7.5时、ICSSG1端口0和端口1正常运行

使用 llvm+clang16.0.0时 、ICSSG1端口0和端口1有时无法接收数据。


具体现象如下:
打开电源时、如果 ICSSG1端口0和端口1正常工作、则该端口将正常工作。
通电时、如果 ICSSG1端口0和端口1无法接收数据、则无法一直接收数据

调试方法和结果:

1、转储 icssg1 MII_G 和 CFG 的所有寄存器,比较正常和异常情况下的寄存器值,值是相同的。
2、转储 MII_G 静态寄存器在异常情况下,发现 MII_G 模块已收到数据,但接收中断没有发生。

您能帮助提供一些调试建议吗、谢谢!

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    您好!

    我们的域专家目前不在办公室,请预计响应时间会延迟。

    此致、

    Nitika

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    嗨、Nitika、Ashwani

    现场侧的一些想法:

    1)由于 PRU MAC STATUS 寄存器显示接收正确的接收编号,我们正在检查数据包 DMA 描述符内存配置、中断路由配置,如果您有更多的检查点和建议,请告知我们。

    2) 2)  接收中断未触发、我们正在检查目标存储器是否已接收到数据。

    2) 2) 由于产品是安全产品、因此客户选择安全编译器  llvm+clang16.0.0、对于编译器差异将影响 PRU 以太网通信的活动、您是否有任何想法或经验? CPSW 在新编译器中运行良好。   

    你好、 邢先生

    有测试结果后、请更新#1和#2。 此外、请分享您在内存集/内存副本上的编译器差异发现的结果、然后我们的专家可以头脑风暴与您一起探讨代码编译器差异 P.o.v 的可能根本原因

    -Thomas

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    补充调试结果:通过打印 MII_g_RT 模块的 Rx 和 TX 正常计数、这两个计数都将增加、表示 MII_g_RT 模块已成功发送和接收数据。 但是从 miiud_RT 到 DMA 接收中断的生成出现故障。 我们如何进一步调查?

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    此问题是否与 https://e2e.ti.com/support/processors-group/processors---internal/f/processors---internal-forum/1466796/am6442-am6442-platform-icssg1-port0-port1有关

    如果是、您是否可以尝试使用最新的 SDK 10.1并提供更新的结果?

    此致

    Ashwani

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    尊敬的 Ashwani:

    这是同一个。 链接中的 POST 在 R5F 上进行了测试、当前问题发生在 A53内核上。  客户使用 Linux SDK9.0 uboot 并将其迁移到在 A53上运行的 RTOS、如果  使用 gcc7.5、PRU 以太网运行良好、如果使用 llvm+clang16.0.0、它将报告上述 POST 问题。

    -Thomas

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    附加调试结果:
    调试方法:在 gcc 和 clang 编译和运行过程中、网卡初始化完成后比较相关寄存器的值(正常和异常情况)
    1)我已经转储 PRU_SDIO_SDIO 寄存器 PRU_SCSSG_CFG 寄存器 PRU_SII_SRT.MII_SRT-RT 寄存器 PRU_SII_SR_RT-GRT 寄存器、发现 CLANG 和 gcc 的编译和运行结果基本相同、没有任何可疑点

    2)我比较了 PKDMA 的描述,发现 clang 和 gcc 的编译和运行结果基本相同,没有任何可疑点

    3)定期读取 MII_g 模块中的 Rx 和 TX GOOD 帧计数以及 RT 环占用寄存器中的值、结果显示 Rx 和 TX GOOD 帧计数增加、而 RT 环占用寄存器没有变化。 因此、MII_g 模块和环之间可能发生故障。 如何进行下一步调试?

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    如果使用  gcc7.5 、PRU 以太网运行良好、如果使用 llvm+clang16.0.0、那么它将报告上述 POST 问题

    可能是我没有得到正确的查询.... 但是、A53不支持 ARM CLANG 工具。

    AM243x MCU+ SDK:版本说明10.01.00

    此致

    Ashwani

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    尊敬的 Ashwani:

    客户未使用 TI arm clang、而是使用功能安全认证方要求的版本。

    Clang 16.0.0发行说明—Clang 16.0.0文档

    根据发布说明、它支持 ARMv8架构、包括 A53。

    @玉川兴,请提供更多背景和信息,以显示所选编译器可以支持 A53内核。

    @ Ashwani 回到测试结果"RT 环占用寄存器没有变化"在失败的情况下,它似乎 DMA 环不能正常工作,你能帮助提供一些 关于这个结果的进一步建议吗?

    -Thomas

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    Clang 可以使用"-March=ARMv8-A+SIMD + FP"来指定 ARMv8 CPU 平台

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    尊敬的 Ashwani:

    除了我们比较的编译器差异外、从硬件工作流程的角度、您对此问题有什么建议吗?  

    "3 μ s)读取 MII_g 模块以及 RT 环占用寄存器中的 Rx 和 TX 良好帧计数、结果显示 Rx 和 TX 良好帧计数增加、RT 环占用寄存器无变化。 因此、MII_g 模块和环之间可能发生故障。 如何进行调试?"

    问题是"RT 环占用寄存器没有变化"

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    您好!

    正式而言、ICSSG 支持不支持 A53。

    不过、我将在 Thread 中添加 ICSSG 专家、以进一步帮助您。

    此致

    Ashwani

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    尊敬的 Ashwani:

    我想了解 ICSSG、PKDMA 和 RingACC 的 MII_G 模块之间的关系和工作原理、以便进一步找出问题所在。 但在 TRM 中找不到相关说明。您能提供一些详细的技术信息吗? 谢谢!

    玉川

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    有关 RingACC 工作方法的讨论如下:

    (+) AM6442:AM6442 PRU 以太网接收数据包 DMA 环形加速器问题-处理器论坛-处理器- TI E2E 支持论坛

    在下次调试时仍需要更多建议。

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     本主题中正在进行讨论:

    https://e2e.ti.com/support/processors-group/processors/f/processors-forum/1473811/am6442-am6442-pru-ethernet-receive-packet-dma-ring-acc-question/5663174#5663174

    BR
    JC