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[参考译文] AFE7444:KCU105 AFE74xx Xcvr 2x44210 JESD 参考设计的 L-M-S-F 的实际定义是什么

Guru**** 2482105 points
Other Parts Discussed in Thread: LMK04828, AFE7444

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/rf-microwave-group/rf-microwave/f/rf-microwave-forum/937906/afe7444-what-are-the-actual-definitions-of-l-m-s-f-for-kcu105-afe74xx-xcvr-2x44210-jesd-reference-design

器件型号:AFE7444
主题中讨论的其他器件:LMK04828

大家好、

我目前正在尝试了解参考设计 KCU105 AFE74xx Xcvr 2x44210 JESD。 我想了解参考设计用户指南中提到的 JESD 模式2x44210。 我查看了有关 L-M-S-F 含义的不同文档、并且更加困惑、无法清楚地理解这些文档。 我参考了以下来源、并尝试与参考设计中提供的 FPGA 方框图进行协作。

https://e2e.ti.com/blogs_/b/analoguewire/archive/2014/09/24/jesd204b-determining-your-link-configuration

https://www.ti.com/lit/ml/slap161/slap161.pdf?ts=1599219122006&ref_url=https%253A%252F%252Fwww.google.com%252F

L-M-F-S 的定义在两个来源上各不相同、我再也没有道理了。

我需要串行器/解串器线路速率7.3728Gbps、因此查看了"AFE74xxEVM 用户指南"中对应的模式、并找到下表

然后从下表中进行选择

是否有人能够在 FPGA 方框图中以及在可能的情况下使用其他图示来阐明以下术语

1)转换器

2)通道

3) 3)特定模式的帧数(此处为2x44210)

基本上是整个 L-M-F-S 部件

 


提前感谢、

Chandrasekhar DVS

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    您好 Chandrasekhar、

    LMFS 的帧格式:44210显示在完整数据表中表107:

    对于2个 Tx 或2个 Rx 模拟(物理)通道、此处的 LMFS 指定为44210。 对于所有四个通道、它被指定为2x44210。 每个 Tx 配置有复数 DUC、Rx 配置有复数 DDC。 因此、每个通道都有一个 I/Q 对(I 和 Q 通道)。 因此、转换器数量(对于 JESD)为每2个物理通道4个。  

    L (通道数)为每2TX 4个(每所有4Tx 8个)

    M (转换器数量)为每2TX 4 (AI、AQ、BI 和 BQ)(所有4Tx 为8、即 AI、AQ、BI、BQ、CI、 CQ、DI 和 DQ)

    f (每帧八位位组数)为2 (每帧每通道一个16位样本)。 SO 2八位位组)

    S (每帧样本数)为1。

    可以很容易地理解这个 LMFS 模式、因为每个 I 或 Q 通道的数据 在一个 JESD 通道上被接收/传输。 总共8个转换器(4个 I/Q 对)数据在8个 SERDES 通道上接收/发送。

    此致、

    Vijay

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    谢谢 Vijay!

    此外、没有关于帧数量(每通道? 还是每个转换器?)。 在本参考设计中 、JESD 模式2x44210的示例格式如所示

    那么、我想了解更多一些内容、

    1)如何为参考设计定义帧(如"每通道帧数"或"每转换器帧数")。 我想知道这一点。

    2) 2)在这种可能使用多个帧的情况下 、LMFC (本地多帧时钟)在每个多帧开始时从低电平变为高电平? (在这里、每通道每两帧)。

    如果您或其他人也能澄清这一点、那将会有所帮助。

    提前感谢、

    Chandrasekhar DVS

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    您好 Chandrasekhar、

    1)如何为参考设计定义帧(如"每通道帧数"或"每转换器帧数")。 我想知道这一点。

    参考设计中显示的示例格式显示了两个帧。

    每帧每通道有2个八位位组。 (在 LMFS = 4421中为 F = 2)。 每个帧有一个来自每个转换器的样本  (在 LMFS = 4421中为 S = 1)。

    如数据表中的表107所示、每个通道的一个帧为2个八位位组。  

    2) 2)在这种可能使用多个帧的情况下 、LMFC (本地多帧时钟)在每个多帧开始时从低电平变为高电平? (在这里、每通道每两帧)。

    在 GUI 中、默认情况下、每多帧的帧数(K)为32。 LMFC 在每个32帧宽的多帧开始时从低电平变为高电平。

    此致、

    Vijay

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    您好、Vijay、

    感谢您的快速回复!

    我还想了解参考设计中使用的不同时钟。

    REFCLK (提供给 AFE74xx EVM) REFCLK 的典型值为368.64MHz
    2. cpll_REFCLK 和 qpll0_REFCLK (连接到 FPGA) 当我将数据速率设置为7.3728Gbps (等于串行数据速率/40)时、cpll_REFCLK 和 qpll0_REFCLK 设置为184.32MHz
    3. LMFC (本地多帧时钟) 不知道该 LMFC 时钟频率是多少以及如何确定该时钟频率。
    AFE74xx EVM 侧的 SYSREF 时钟 SYSREF 脉冲源应与器件时钟同步。 这是否意味着 AFE74xx EVM 上的 SYSREF 时钟等于基准频率? 如果没有、如何计算 SYSREF 时钟频率?
    5、时钟到 DAC 对于44210 (2TX/Rx)模式、DAC 的内插因子为24x。 因此、时钟为24 x 368.64MHz = 8847.36GHz
    6.到 ADC 的时钟 ADC 的时钟应为 DAC 时钟/2或/3或/4、且应小于3GHz。 因此,对于/3,时钟为2949.12 GHz

    我想知道上述解释的信息对于所述模式是否准确、以及如何计算 LMFC。

    您还谈到了帧时钟频率、对吗? 我如何计算它?

    请在此处指导我吗?

    提前感谢、

    Chandrasekhar DVS

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    您好 Chandrasekhar、

    AFE 参考时钟、FPGA 参考时钟、DAC 和 ADC 采样时钟的解释和频率是正确的。 请注意、AFE 和 FPGA 的参考时钟由 EVM 上的 LMK04828提供。 DAC 时钟由 AFE 的内部 PLL 生成。 内部 PLL 输出的3分频时钟用作 ADC 时钟。

    在此模式下、内插前的 Tx 输入数据速率和抽取后的 Rx 输出数据速率均为368.64MSPS。 (请注意、这不需要等于 AFE 的参考时钟频率、  在本例中、该频率恰好也是368.64MHz)

    由于 S=1、一个帧有一个来自每个 DAC 或 ADC 的输出/输入样本(在内插或抽取之前)。 因此、这里的帧时钟频率等于输出/输入数据速率、即368.64MHz。  

    每多帧的帧数为32。 因此、多帧时钟频率为(帧时钟频率)/ 32 = 368.64/32 = 11.52MHz。

    SYSREF 频率必须是 LMFC 频率的次谐波。 默认情况下、EVM GUI 将其选择为0.96MHz。 有关 SYSREF 频率计算的更多详细信息、请参阅 数据表的第7.3.4.4.2节。

    此致、

    Vijay

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    您好、Vijay、

    [引用 user="Vijayendra Varma Siddamsetty"]每个多帧的帧数为32。 因此、多帧时钟频率为(帧时钟频率)/ 32 = 368.64/32 = 11.52MHz。[/引述]

    因此、当我导航到数据表的第7.3.4.4.2节时、我看到了一个计算 LMFC 的公式、给出如下

    LMFC =通道速率/40/F/K (假设 LMFS 是文档中的一个拼写错误、因为在参阅同一页中的示例时没有意义)

    F:每帧八位位组数

    K:每通道的帧数

    通道速率:串行器/解串器通道速率

    对于参考设计 LMFS - 44210中的模式、通道速率为7.3728Gbps、K=32、并且 F=2。 代入这些值、我得到一个不同的值(2.88MHz)。 现在、这与您提到的内容有何不同?

    请您澄清本节内容吗?

    [引用 user="Vijayendra Varma Siddamsetty"]SYSREF 频率必须是 LMFC 频率的次谐波。 默认情况下、EVM GUI[/QUERP]选择的频率为0.96MHz

    您能否指出您是如何解决这个问题的? 因为当我查看 EVM GUI 中的不同选项卡时、我在任何地方都看不到如此明显的值、并且无法从任何地方解释。

    下面是 EVM GUI 中的 PLL2和 SYSREF 以及 SYNC 选项卡。 所有值之后。 您能指出其中的相关部分吗?

    提前感谢、

    Chandrasekhar DVS

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    您好 Chandrasekhar、

    通常、对于8位/10位数据编码、LMFC 频率等于(通道速率/ 10/ F/K)。 在 FPGA 中、LMFC 为11.52MHz。 对于 AFE7444、由于采用内部数字时钟架构、分母中还有一个额外的4因子。 因此、您的计算是正确的 LMFC 为2.88MHz、SYSREF 必须是2.88MHz 的子谐波。 0.96MHz 仍然满足这个条件。  

    来自 LMK 的 SYSREF 频率等于(PLL2 VCO 输出:2949.12)/(SYSREF 分频器)。 在您发送的屏幕截图中、SYSREF 分频器值为256。 但在对 EVM 进行编程后、应将其更改为3072。 然后 SYSREF = 2949.12/3072 = 0.96MHz。

    此致、

    Vijay

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    您好、Vijay、

    [引用 user="Vijayendra Varma Siddamsetty"]在您发送的屏幕截图中、SYSREF 分频器值为256。 但在对 EVM 进行编程后、应将其更改为3072。 然后 SYSREF = 2949.12/3072 = 0.96MHz。[/引用]

    现在、对 EVM 进行编程后、分频器值从256变为3072意味着什么? 应用所有配置设置后、我看到 SYSREF 分频器值从3072变为256。  

    编 程 EVM 后、您能否解释一下您的意思以及 SYSREF 分频器的值保持多大相关性?  

    Chandrasekhar DVS

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    您好 Chandrasekhar、

    我在 EVM 上进行了验证、并且在对 SYSREF 分频器值进行编程后、该分频器值为256。 这意味着 SYSREF 被设定为11.52MHz。 当我说3072时、我没有设置 EVM、而是在仿真模式下运行 GUI。 请忽略值3072。 很抱歉造成混淆。

    这不满足 SYSREF 应为 LMFC 子谐波的要求。 但是、事实证明它可以在 EVM 上工作。 因此、这对于评估平台来说是可以接受的。 请确保您的系统满足此要求(SYSREF 分频器可使用3072)。  

    此致、

    Vijay

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    您好、Vijay、

    我们将首先使用 EVM。 但是、我们需要针对我们的应用使用 AFE7444芯片进行一些研发。 在这种情况下、了解参考设计的基础知识将会有所帮助。 当您说256的 SYSREF 分频器值不满足次谐波条件时、GUI 为什么设置该值? 我之所以提出这一点、是因为在稍后我们可能需要决定更改配置(JESD 接口的工作模式、AFE7444芯片的参考时钟)时、我们希望预测相关参数。  

    您能否建议如何以一致的方式预测相关性?

    提前感谢、

    Chandrasekhar DVS

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    您好 Chandrasekhar、

     在 LMK 编程中、GUI 不会考虑 LMFC 条件的次谐波。 但是、 在单击"快速启动"选项卡中的"设置模式"按钮后、可以手动更改 SYSREF 分频器值、然后单击"运行完成启动序列"按钮。  

    针对 GUI 中的所有模式对 AFE7444进行了正确编程(已验证这些模式)。  单击"Run Complete Startup Sequence"按钮后、可以从 GUI 创建配置文件。 此配置文件可用于对系统中的 AFE7444进行编程。  

    此致、

    Vijay