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器件型号:TRF3722 戴尔
在 TRF3722数据表中、CAL 建议为600kHz。
在600kHz 或更高频率下使用 CAL_CLK 时、会出现什么问题?
使用625khz 有什么问题?
谢谢你。
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您好、Henry、
CAL_CLK 是驱动器件校准逻辑的器件、该器件是基于 CAL_CLK_SEL 的基准频率的缩放版本。 使用一个更快的 CAL_CLK 频率、例如600KHz、 将导致一个更快的校准时间、但代价是精度。 我的意思是失去精度、逻辑器件可以选择非最佳 VCO、这种 VCO 仍会锁定在所需的频率、但会处于失锁的边缘。 温度、电压和频率的微小变化可能会使其超过边缘。 因此、通过使 CAL_CLK 超过600KHz、该器件更容易受到此类问题的影响。
建议将 CAL_CLK_SEL 保持在/16至/128的值、以使 CAL_CLK 保持较慢、从而为 VCO 校准逻辑提供更多时间来选择最佳 VCO。
如果您对锁定时间有任何顾虑、那么我建议查看 TRF3765合成器锁定时间 应用手册以了解 有关数字校准的更多信息。
此致、
奥斯卡