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[参考译文] IWR6243:级联系统中帧同步信号的最大 PCB 失配

Guru**** 2763585 points

Other Parts Discussed in Thread: AWR2243

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/sensors-group/sensors/f/sensors-forum/1612489/iwr6243-max-pcb-mismatch-for-frame-sync-signal-in-cascaded-system

部件号: IWR6243
主题: AWR2243 中讨论的其他器件

您好、

在下面的 POST 中、表明帧同步的 PCB 布线不匹配最大为~5ns。 但是客户认为 5ns 不匹配是帧同步的一个很大的布线长度差异。 因此、他们想知道 TI 建议的帧同步不匹配最大 5ns 的原因和方式。 您可以提供帮助吗?

(1) AWR2243:级联系统中的帧触发延迟影响 — 传感器论坛-传感器 — TI E2E 支持论坛

因此、PCB 应进行长度匹配、以实现~5ns 或更低的延迟。

谢谢、

Chris

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    嗨、Chris、

    我们正在查看您的查询。 请给我们一些时间来答复。

    谢谢、
    Saransh

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    您好、Chris、

    我们仍在内部进行研究。 请给我们一些时间来检查和恢复。

    此致

    Ankit

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    您好、

    是否有任何更新?  

    谢谢、

    Chris

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    您好、Chris、

    我没有听到内部团队的反馈。 请允许我在几天内进一步跟进。 我知道详细信息后会联系您。

    此致

    Ankit

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    进行了如下更新。

    客户需要将总不匹配度保持在 10ns 以下。 从器件侧、根据表 1、我们看到的不确定性约为 5ns。  AWR2243 级联中的 DIG_SYNC_IN 不平衡汇总应用手册 (SWRA574B) 展示了。  这意味着在 PCB 侧、失配需要保持小于 5ns、以将整体失配保持在 10ns 以下。