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[参考译文] IWR6243:双芯片级联雷达的 TDM 实现(IWR6243)

Guru**** 2553450 points
Other Parts Discussed in Thread: IWR6243

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/sensors-group/sensors/f/sensors-forum/1467627/iwr6243-tdm-implementation-for-2-chip-cascade-radar-iwr6243

器件型号:IWR6243

工具与软件:

您好!

我正在致力于为 IWR6243级联传感器实现 TDM。 目前、我们有 Sitara SDK 中针对这种级联配置的 DDMA 实现。 我修改了 chirpCfg 以确保一次仅启用一个发送器。 但是、我希望确保每个帧中的线性调频脉冲序列遵循此特定 TDM 顺序:

[ Master_Tx 1、Master_Tx 2、Master_Tx 3、Slave_Tx 1、Slave_Tx 2、 Slave_Tx 3, Master_Tx 1,...]

我的担心是、在 chirpCfg 中进行修改后、可能仍然存在重叠的激活、在这种激活中、主器件的 Tx1和从器件的 Tx1同时启用、然后是从主器件的 tx2和从器件的 tx2中同时启用线性调频脉冲、等等。

是否有专门针对双芯片级联雷达设置的 TDM 实现或指南可用于实现所需的 TDM 线性调频脉冲序列?

此致、

Attiya

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你好。

    目前、我们没有任何可用于 TDM 的级联演示实现。

    此致、

    Santosh