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[参考译文] CC1101:CC1101不能在1.2kBaud 模式下使用 SmartRF 生成的寄存器设置

Guru**** 2543460 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/wireless-connectivity/sub-1-ghz-group/sub-1-ghz/f/sub-1-ghz-forum/682840/cc1101-cc1101-doesn-t-work-in-1-2kbaud-mode-with-smartrf-generated-register-settings

器件型号:CC1101
通过 SmartRF 生成的4.8kBaud 灵敏度优化设置、一切都很适合我: 0x29、 0x2E、 0x06、 0x47、 0xD3、 0x91、 0xFF、 0x04、 0x05、 0x00、 0x00、 0x06、 0x00、 0x10、 0xA7、 0x62、 0xC7、 0x83、 0x13、 0x22、 0xf8、 0x40、 0x07、 0x30、 0x18、 0x16、 0x6C、 0x43、 0x40、 0x91、 0x87、 0x6B、 0xFB、 0x56、 0x10、 0xE9、 0x2A、 0x00、 0x1f、 0x41、 0x00、 0x59、 0x7f、 0x3F、 0x81、 0x35、 0x09 更改为这些 SmartRF 生成的1.2kBaud 设置: 0x29、 0x2E、 0x06、 0x47、 0xD3、 0x91、 0xFF、 0x04、 0x05、 0x00、 0x00、 0x06、 0x00、 0x10、 0xA7、 0x62、 0xf5、 //以上行从0xC7、 0x83、 0x13、 0x22、 0xf8、 0x15、 //以上行从0x40、 0x07、 0x30、 0x18、 0x16、 0x6c、 0x03、 //以上行从0x43、 0x40、 0x91、 0x87、 0x6b、 0xFB、 0x56、 0x10、 0xE9、 0x2A、 0x00、 0x1f、 0x41、 0x00、 0x59、 0x7f、 0x3F、 0x81、 0x35、 0x09 导致所有 Rx 尝试失败。 GDO0永远不会变为高电平(在 GDO0_CFG[5:0]= 0x06时)、这意味着永远不会看到同步字。 将前两 个不同的寄存 器改回4.8kBaud 设置可以解决该问题、因此上述第三个寄存器更改指定的最大数字增益设置的更改不会涉及该问题。 因此、根据数据表中的 forumulas: 工作4.8kBaud 设置的通道带宽和 f_dev 设置为: mdmcfg4:0XC7、chanbw_e:3、chanbw_m:0、drate_e:7 BW 通道:101562.520000 deviatn:0x40、deviation_e:4、deviation_m:0 F_DEV:25390.619000 、对于不工作的1.2kBaud 设置、它们是: mdmcfg4:0xf5、chanbw_e:3、chanbw_m:3、drate_e:5 BW 通道:58035.730000 deviatn:0X15、deviation_e:1、deviation_m:5 F_DEV:5157.470700 这些值与 SmartRF 在 其生成的标头中插入的数字一致(包含上述突发模式寄存器设置数组)。 我的问题是: 1. TI 是否知道显示的1.2kBaud 设置是有效配置、 至少在经过验证的硬件上是有效配置? 2.对可能出现的问题或需要采取的下一步骤有什么想法? 谢谢、 Britton
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    我再次尝试制作更好的格式化版本、它说已经有一个相同的线程、所以我猜格式化再次失败。 我想我稍后会从窗口重试、但 Sheesh 为什么会忽略我的所有格式
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    由于格式化、很难读取您的帖子。

    SmartRF Studio 生成的1.2kbps 设置正常工作。

    您是否已验证电路板上的频率是否符合您的预期(无频率偏移)?
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    由于不活动、我将关闭此线程。 您可以通过提交回复来再次打开主题帖。
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    频率偏移确实是问题所在。 433MHz 频带上1.2kBaud 的默认设置导致通道带宽仅约为58kHz。 如 TI 设计手册 DN005和 DN015中所述、较差的晶体容差是最终问题。 对于我拥有的许多器件、将 FOCCFG.FOC_LIMIT 设置为3 (BW_CHAN/2)足以使事情正常工作、但并非所有器件都正常工作。 我必须在老化时通过 FSCTRL0.FREQOFF 设置实施扫描。 我原来的帖子太乱了、因为这些内容可能是一个常见的问题、可能会在勘误表或其他内容中提及(尽管可能对于达到晶体容差规格的模块而言、这不是一个问题)。