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[参考译文] SN74CB3Q3257:信号直流电平问题:引脚14和13短接在一起

Guru**** 2390755 points
Other Parts Discussed in Thread: SN74CB3Q3257

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/switches-multiplexers-group/switches-multiplexers/f/switches-multiplexers-forum/975004/sn74cb3q3257-signal-dc-level-issue-pin-14-and-13-shorted-together

器件型号:SN74CB3Q3257

 我们将 SN74CB3Q3257用作 ASPI 多路复用器。 B 侧连接到 BMC 和 CPLD、A 侧连接到闪存。

引脚14 (4B1)和引脚13 (4B2)短接在一起、用于由 CPLD (Max10)驱动的 CS#

我们看到逻辑低电平偏移至1.43V (当 CPLD IO 为 LVTTL 和8mA 时)

当 CPLD IO 为 LVCMOS 2mA 时、逻辑低电平为1V。

另一个信号、如 CLK、MISO、由 CPLD 驱动的 MOSI、看起来正常。

 SN74CB3Q3257是否存在任何不  允许引脚短路的内部电路问题???

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    B1/B2引脚短接应该没有问题。

    请测量 A 和 B 引脚上的电压。 整个电压降是否为1.43V?

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    尊敬的 Sambit:

    您是否可以尝试重新上传看起来没有正确显示的图片-我想确保原理图中没有任何错误。 据说、将两个引脚短接在一起不会出现任何固有问题-但是重新上传图片会很好、因为我无法准确地判断问题是什么。  

    请告诉我。

    最棒的

    Parker Dodson