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器件型号：SN74LV4051A 您好！
请告诉我 SN74LV4051A 的通道开关延迟时间。
能不能有人告诉我该器件 SN74LV4051A 是否支持此开关速度
从一个通道到下一个通道、不会对8个模拟通道施加的电压产生任何干扰。
例如：
当通过 INH=L 固定的方式控制 A、B 和 C 时、我想知道 Y2到 Y4的延迟时间。
此致
您好！
请告诉我 SN74LV4051A 的通道开关延迟时间。
能不能有人告诉我该器件 SN74LV4051A 是否支持此开关速度
从一个通道到下一个通道、不会对8个模拟通道施加的电压产生任何干扰。
例如：
当通过 INH=L 固定的方式控制 A、B 和 C 时、我想知道 Y2到 Y4的延迟时间。
此致
你好，Cafain，
我对 SN74LV4051A 进行了一些切换通道间的延迟测试。 在图1中可以观察到常规测试设置。 对于这些测试、COM 引脚上的输入信号只是一个恒定电压。 在这些测试中、通道 Y0和 Y1之间的开关延迟得到了确定。 由于我们期望该特定器件中的其他通道具有相似的性能、因此仅对这些通道进行了评估。 通道1 (黄色)对应于引脚 A 输入的用于在通道 Y0和 Y1之间切换的信号、而通道3 (品红色)对应于 Y0和通道4 (绿色)对应于 Y1。 图2显示了从通道 Y0切换到 Y1时观察到的延迟、该延迟为~19.6ns。 图3 和4显示了从 Y1转换到 Y0的延迟。 此开关观察到的最大延迟 为~12.4ns。
图1.
图2.
图3.
图4.
您好、Cafain-San、
在下面的图1和图2中，是同时切换 A、B 和 C 时得到的结果。 对于我的结果 、COM 的输入与 Y0和 Y7的输出之间存在明显的下降(~600mV)。 由于我使用的特定设置、这实际上是预期的行为、如图3所示。 SN74LV4051Aswitch 两端的压降量取决于输入电源的端接阻抗以及 Y 引脚处的负载。 另一个重要因素是 SN74LV4051A 中内部 FET 的寄生 Ron 电阻。 本质上、出于简化的目的、这些 FET 可被视为电阻器(图4)、在负载和源阻抗之间形成一个分压器(图5)。 通过查看数据表(表1)"电气特性"部分中的 Ron、可以看到、根据 Vcc、温度和器件变化、此寄生电阻的范围介于22 Ω 至600 Ω 之间。 因此、如果负载阻抗较小、很可能会观察到不同单元之间的输出电压不一致。 但是、如果您的负载比 Ron 大10到100倍、则应该会看到开关上的压降非常小。
图1.
图2.
表1.
您好、Cafain-San、
根据数据表中的说明、在 Y7输入信号和在 COM 输出不应成为问题。 此外、输入来自 Y0的信号和输出到 COM 不应成为问题。 通过在引脚 A、B 和 C 上设置逻辑电平、您基本上可以确定 COM 的信号路径。 如果您观察到偏离此目的的行为、请告知我们。
