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F28M35 TZ引脚的问题

Other Parts Discussed in Thread: CONTROLSUITE

请教专家关于F28M35 TZ引脚的问题。最近在设计F28M35的最小系统,之前设计过28335的最小系统,28335里TZ引脚共6个,并且位置固定,而在F28M35的引脚功能里,并没有具体给出TZ的相关信息,查阅资料,发现F28M35里,TZ1~TZ3是与GPIO口复用,并且可配置到GPIO0~GPIO63的任意引脚中,而TZ4只能由EQEP模块中的err信号触发,TZ5和TZ6也被指定了某一信号来触发。按照上述内容,F28M35中TZ引脚开放给用户的实际上也就3路,如果用F28M35实现一个背靠背系统的控制或者所设计系统中需要超过3路的信号来触发TZ,是不是就无法实现了?谢谢!

  • 您好,

    F28M35最小系统设计可参考C:\ti\controlSUITE\development_kits\~controlCARDs\CCF28M35xxHWdevPkg_v3

  • 参考了,但是里面没有具体体现出TZ引脚啊。

  • 我也遇到了超过3个保护点,目前想用定时器或中断去实现另外的点, 不知道你是如何实现的。
  • C2000里面只有三个保护输入引脚,如果不需要识别出哪个信号,那么可以直接将两个保护信号同时接到相同的TZ。 如果需要区分,那么可以考虑再增加IO口去判断是哪个信号。
  • 没有看懂意思,我目前是这样写的
    GpioCtrlRegs.GPCPUD.bit.GPIO78 = 0; // Enable pull-up on GPIO69 (TZ2)
    GpioCtrlRegs.GPCQSEL1.bit.GPIO78 = 3; // Asynch input GPIO69 (TZ2)
    InputXbarRegs.INPUT2SELECT = 78; // GPIO91作为Input2

    GpioCtrlRegs.GPCPUD.bit.GPIO86 = 0; // Enable pull-up on GPIO69 (TZ1)
    GpioCtrlRegs.GPCQSEL2.bit.GPIO86 = 3; // Asynch input GPIO69 (TZ1)
    InputXbarRegs.INPUT1SELECT = 86; // GPIO91作为Input1

    GpioCtrlRegs.GPCPUD.bit.GPIO89 = 0; // Enable pull-up on GPIO69 (TZ3)
    GpioCtrlRegs.GPCQSEL2.bit.GPIO89 = 3; // Asynch input GPIO69 (TZ3)
    InputXbarRegs.INPUT3SELECT = 89; // GPIO91作为Input1
  • 没有看懂意思,我目前是这样写的
    GpioCtrlRegs.GPCPUD.bit.GPIO78 = 0; // Enable pull-up on GPIO69 (TZ2)
    GpioCtrlRegs.GPCQSEL1.bit.GPIO78 = 3; // Asynch input GPIO69 (TZ2)
    InputXbarRegs.INPUT2SELECT = 78; // GPIO91作为Input2

    GpioCtrlRegs.GPCPUD.bit.GPIO86 = 0; // Enable pull-up on GPIO69 (TZ1)
    GpioCtrlRegs.GPCQSEL2.bit.GPIO86 = 3; // Asynch input GPIO69 (TZ1)
    InputXbarRegs.INPUT1SELECT = 86; // GPIO91作为Input1

    GpioCtrlRegs.GPCPUD.bit.GPIO89 = 0; // Enable pull-up on GPIO69 (TZ3)
    GpioCtrlRegs.GPCQSEL2.bit.GPIO89 = 3; // Asynch input GPIO69 (TZ3)
    InputXbarRegs.INPUT3SELECT = 89; // GPIO91作为Input1
    但是,我还有5个硬件保护的点,那我能否也一起接入到TZ1-TZ3其中的任何一个吗? 相当于一个TZ1信号是由几个IO口共同触发的。若可以的话,如何实现?