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FPGA 通过SRIO给6678发数的问题



使用FPGA V6给6678发送数据,速率配成5Gb,使用四个1x,现象是只能收到中断,DDR里却没有数据,从FPGA那端看,数据已经发送给FPGA的srio内核了说,这个有可能是什么原因?在6678那边有没有什么途径可以看FPGA是不是有数过来以及DDR的状态是不是正确呢?