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同一个核自身的L1和LL2之间的数据一致性是由硬件自动维护的；不同核之间的L1和L2的一致性需要手动维护。 cache的原则就是：多核直接操作的共享memory，写之后要write back cache，读之前要invalid cache。cache原理及一致性维护可以看c66 corepac user guide。
