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1.如果跑一段包含Cache miss,以及相关Stall,TSCL计数也应该包含这些Stall吗？
2.程序放在内存和外存，TSCL计数不一致，是不是由于L1P miss,或L1D miss造成的？
1. 包含。
2. 内存外存访问速度不一致所致。
Allen你好，可否追问一个问题，环境是6678LE：
我的一个工程需要读多个文件（文件存放在PC硬盘上，只有仿真器连接），TSCL/TSCH寄存器测得的结果很小，但是实际时间大概需要12分钟，请问这是什么情况。
你好，请问您的问题解决了吗？我也碰到了类似的问题，C6748，用TSCL/TSHL寄存器测得程序运行时间为2.4s，但是CCS5.5中跑完的实际时间远大于这个数，请问您是怎么解决的？
期待您的回复！
