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DM368硬件设计问题咨询 关于DDR匹配电阻和EMIF总线等问题



HI 各位大侠,我公司现在在设计一款基于DM368平台的IPC产品,现在碰到如下问题,请解答,感激: 1:GPIO0有啥特殊?没使用时上拉了。 2:如果PCB布局紧张,DDR2和DM368之间串联的33R匹配电阻是否可以删掉? 3:PRTCSS的PWCTRO和PWCTRIO是否可以做一般的GPIO? 4:看门狗的喂狗WDI信号,是否可以使用PRTCSS的IO信号呢?哪个可以使用? 5:CLKOUT0/1/2有啥区别?我需要给外部的sensor板输送一个37.125M或74.25M时钟,应该使用哪个?此外,DM368上VPFE的CLKOUT0_GPIO93_WEN引脚是否可以输出时钟给SENSOR板呢? 6:EMIF总线,如果连接了外部设备如FPGA(使用到EM_CLK和EM_ADV等),还可以使用EM_CLK等做GPIO么?如果AEMIF总线,其中一部分连接到了NAND FLASH,同时复用连接FPGA芯片,该如何设计,是否需要串联匹配电阻,该如何串联,即在368端串联匹配电阻,再各在NAND和FPGA端串联匹配电阻? 7:DM368输出的模拟视频信号CVBS/YPBPR,是否要加运放?如果加的话,运放芯片是靠近DM368还是靠近输出接口即可?因为我们现在的DM368板子很小,放不下运放芯片了?音频运放也同理。 谢谢。 可电话我13811049846李