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1.在SRIO_SERDES_LOOPBACK时，外部的端口TX与RX需要短接吗？如果短接会有什么影响？
2.在SRIO_SERDES_LOOPBACK debug模式，程序在Keystone_SRIO_wait_LSU_completion（）函数中死循环，即LSU_state.LSU Context Bit与reg6.LCB,不相等，这说明什么？硬件坏了吗？
1.SERDES loopback不需要短接外部管脚，通过配置在内部实现
2. 如果 context bit和 lcb不匹配，只是说明当前传输完成的complete code不是你当前传输那次操作，有可能是当前传输并没有完成就读取了CC码，所以CC有可能是前一次操作的
出现这种情况，大概是哪里出问题了？我用的是你们给你例程。
传输128字节，都等了2分钟了，uiCompletionCode始终不等于transfer->contextBit 。这怎么可能？
