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AM3354，OSC0硬件设计石英晶体频率为24MHz，但是SYSBOOT[15:14]为00，即选为19.2MHz，硬件引脚这样连接后，会有怎样的风险呢？

jerry_cg
Prodigy 40 points
Other Parts Discussed in Thread: AM3354

AM3354，OSC0硬件设计石英晶体频率为24MHz，但是SYSBOOT[15:14]为00，即选为19.2MHz，如果这样设置的话，那通过ADPLLS、ADPLLLJ输出的CORE_CLKOUTM6、CORE_CLKOUTM4、CORE_CLKOUTM5、PER_CLKOUTM2等时钟输出会不会受影响呢？目前串口是可以正常通信，想知道硬件引脚这样连接会不会有风险呢？

  • 0
    Prodigy 40 points

    有人能帮我解答一下吗？目前我们的硬件没有将SYSBOOT[14]引脚拉高，那这样的话，就是选择了19.2MHz模式，而实际上外部晶振为24MHz，目前系统可以正常运行，串口、sd卡也都可以正常工作，但不知道这样系统时钟会不会受影响呢？比如串口的时钟为48MHz，那现在模式选择为19.2MHz后，串口的时钟是不是还是48MHz了呢？

  • 0 回复 jerry_cg
    TI__Mastermind 35157 points

    会有影响，我又客户搞错了这个，出现过问题，所以请您修改硬件。

  • 0 回复 Yaoming Qin
    Prodigy 40 points

    Qin工：

       首先，非常感谢您的回答。然后我还有几个问题咨询一下，还请麻烦帮我回复一下：

         我想问下，如果我不想改硬件，想在软件上，强制认为目前就是SYSBOOT[15:14]的值就是01，可以实现吗？这个SYSBOOT[15:14]的判断应该不是在u-boot的代码里面吧？是在第一级引导ROM代码里面呢？能修改ROM代码实现我上面所说的功能吗？