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AWR6843ISK: MSS_VCLK在系统上电后能更改CLK_DIV与CLK_source么,更改这两个参数需要reset MSS_subsytem吗?

Part Number: AWR6843ISK

尊敬的TI工程师们

         你们好

我在使用AWR6843ISK进行项目开发的过程中,有一个需求: 需要在上电后在某一个event后更改MSS_VCLK的时钟分支的分频系数和时钟源。

我在520e文档中,找到了对应MSS_VCLK时钟支路的分频器和时钟源的配置字段如下1.  CLKSRCSEL1.VCLKCLKSRCSEL 用于配置MSS_VCLK的时钟源

2. CLKDIVCTL0.VCLKDIV 用于配置MSS_VCLK的分频系数。 这两个字段皆为可读可写字段

但是,文档中未能明确 在上电后配置MSS_subsystem的历程。

文档中不推荐用户在上电后更改这两个字段

那么请问TI工程师,如果我需要在上电后更改这两个字段。是否会自动触发MSS_subsystem的reset?  或者TI工程师能否提供一种方法用于更改上电后的MSS_VCLK时钟分支的时钟源和分频系数?