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DAC5675A 中Output setting time和update rate的关系？

xu chen
Prodigy 60 points
Other Parts Discussed in Thread: DAC5675A

最近要用DAC5675A芯片做数模转换，在芯片手册上，update rate最大为400MSPS，而output setting time的典型值为12ns，也就是说输入的数字信号12ns后才能转化为正确的模拟信号，那么update rate最大应该等于1000Msps/12=83MSPS,这就与400MSPS矛盾了，请问专家如何才能正确理解这其中的关系？

  • 0
    Intellectual 856 points

    对这个问题也有些困惑，等待专家的详细解答。

  • 0
    TI__Mastermind 30930 points

    Chen

    settling time是指输出的建立时间，是指输出必须达到稳定的时间。

    setup time建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间（多用在数字域)。

  • 0 回复 Seasat Liu
    Prodigy 60 points

    你好，首先感谢你的热心回答，我还是有些疑惑，setting time是12ns，是不是意味着我输入输入数据的频率不能大于83M呢？那这个400Msps的update rate又有什么用处呢？希望赐教

  • 0 回复 xu chen
    TI__Intellectual 1960 points

    你好!

    你可能混淆了settling time和输出的建立时间(rising time/falling time)的概念.

    rising/falling time和update rate 相挂钩, 快速率的转换, 需要短的output rising time 才能让输出能够跟上.

    而settling time包含了两个码之间的转换的rising time + 输出稳定到一定精度内的时间.

    可能用个图说明更直接一些:

     

    而5675的指标书里: rising/falling time只需要2ns, (可以对应到接近500M的转换速度). 12ns的稳定时间只是稳定到需要的精度内的时间. 这个是所有的模拟电路所固有的一个稳定需求时间,  但是并不影响转换速度.

    谢谢!

  • 0 回复 Vera Mao
    Prodigy 60 points

    非常感谢您的耐心解答，我还想问一下，就是如果我用200M/s的速率输入数据，那么转化成模拟信号的精度能达到多少呢？谢谢

  • 0 回复 xu chen
    TI__Intellectual 1960 points

    你好,

    一般高速DAC的考量指标不说精度, 一般用频域的SNR来��征.

    如果从时域里来看它的稳定时间的话, 指标书只给出了0.1%的稳定时间,没有给出其他档位的稳定时间.所以很难说在某个采样速率下的输出精度. (这个指标其实还要和后面跟的电路挂钩, 另外采样时钟上抖动指标, 也会影响它).

    谢谢!