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这是我抓取的数据绘制的图，我配置的寄存器是测试信号，为什么画出来是这个，此外，DRDY也没有脉冲
您好，
Ze A 说：DRDY也没有脉冲
DRDY没有脉冲，那就是设备没有进行AD转换。您是否启动了AD转换？拉高START pin 至少2 tCLK周期或发送START命令可以启动转换。
您意思拉高START后至少等待2个Tclk才能发送RDATAC
我的意思是至少拉高这么长时间，连续转换的话您也可以一直拉高START pin。读取数据的话，需要等到DRDY拉低，DRDY拉低说明AD转换已完成。
对呀，我的START信号，一开始为低电平。我的主控发出信号的顺序：PWDN和RESET复位状态下为低电平，然后拉高，等待1s后，RESET拉低并持续大概2us，随机拉高RESET，随后给DIN发送SDATAC指令并开始配置寄存器操作，当寄存器配置完成，START拉高随后发送RDATAC指令，等待DRDY拉低传送数据
我想请问当START未拉高时，DRDY处于低电平吗？此外当START拉高后DRDY那个Settle time怎么解释 我有点不太明白
针对Figure46，在START拉高和DRDY出现第一个下降沿时，中间的那部分时间是否就是settle time，无论是建立时间结束的下降沿，还是随后以固定速率出现的DRDY脉冲，其下降沿都表示数据准备完成
Ze A 说：我想请问当START未拉高时，DRDY处于低电平吗？
这里不确定，所以下图中在START未拉高时，DRDY有两条线一条高电平实线，一条低电平虚线，表示这两种情况都有可能。
Ze A 说：此外当START拉高后DRDY那个Settle time怎么解释
Settle time就是START拉高至DRDY低电平的时间，如下图所示，因为是delta-sigma ADC，启动转换后第一个Settle time一般较长，但是随后的DRDY信号会以设置的数据速率拉低，或者说随后的转换数据会以设置的数据速率完成转换。
那就意味着这个Settle time结束的下降沿，已经有一组数据准备就绪了
是的，数据准备就绪就会有DRDY下降沿
