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我将使用 Altium 中 TI 网络设计资源中的 PSpice sim 模型、并收到以下错误消息(随附 pic)。 您能帮助解决这些错误吗?
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嗨、Avdit、
对于非工作时间的延误、我深表歉意。
该模型未在 Altium SPICE 中进行测试、但可能违反了某些半项规则。 可能有一种情况、即行470中"VCLKF1"和"2"之间的空格太多? 或者类似的东西。
我已经编辑了模型网表、将这里的空间减少为一个并附上。
您是否可以尝试使用此网络表重新测试模拟以查看它是否修复了与 VCLKF1_0相关的错误消息?
您是否已安装其他必要的 Altium SPICE 库、例如包含 PWL 的仿真源代码库?
您能否发回完整的错误消息日志?
您是否为 pspice 模型使用了 Altium Spice 宏导入向导/扩展?
此致、
彼得
嗨、Avdit、
这里是经过编辑的网表(仍然具有原始.lib 扩展名、但这应该可以轻松更改)。
您是否可以向我发送非意外仿真行为的屏幕截图?
是否将 TR_MODE 设置为0。
此致、
彼得
尊敬的 Peter:
我必须编辑您的文件以删除 PWL 实例。
我有一个自举电路、输入对于 INA283而言、预计将放大200x、因此对于5mV 输入、输出应该大约为1V、但您可以看到、即使输入电压发生变化、输出也大约为4mV。
我使用 LTSpice 进行了完整性检查、它可以在那里工作、但 LTSpice 也不会对 PWL 实例有问题。
如果您有 Altium、可以使用建议的模型文件试用吗?
此致!
Avdit
嘿、Advit、
我在 Altium 23中执行了仿真、得到了相同的结果。 我确实收到了许多警告、这些警告可能会干扰模型运行。 请参阅下面的仿真日志。
出于某种原因、Altium SPICE 不认识某些模型参数、也不认识拉普拉斯函数的使用。 当我在.SUBCKT ZOH_0.E1中删除了拉普拉斯函数的使用并将其替换为增益为1的 VCVS 时、Zoh 上的误差消失、但现在器件输出稳定在 Vs 电源轨内。 在我的第二次修改中、请参阅以下内容:
我想知道 在 PMOS 模型中被忽略的 RDS 参数是否会影响输出的时序。 我不知道它们为什么无法被识别、但可能需要根据 Altium SPICE 语法调整 PMOS 模型才能使该模型正常工作。
您能否联系 Altium 获取语法文档、了解它们接受哪些 PMOS 级别和/或参数?
此致、
彼得
尊敬的 Peter:
下面是我从 Altium 支持团队获得的反馈-
这是我们基于知识的文章、介绍了我们的混合仿真引擎当前使用的受支持的 SPICE 引擎。
www.altium.com/.../understand-spice-models-supported-in-altium
NGSpice 不支持进行拉普拉斯变换挖掘、因此默认情况下、我们的 SPICE 引擎不支持该变换。
nmg.gitlab.io/.../laplace.html
这是我们用于 NGSPICE 的官方手册、RDS 参数仅用于 VDMOS 模型。 因此、其他 MOSFET 型号不支持该模式。 如果您使用通用仿真模型并查看其参数、这也将反映出来。 只有 VDMOS 模型有一个 RDS 参数。
https://ngspice.sourceforge.io/docs/ngspice-manual.pdf
希望以上内容有所帮助!
此致!
Avdit
嗨、Avdit、
我不知道发生了什么、但我在 Altium 中重新实例化了 INA283模型、然后进行了相同的更正:(删除了 PWL 并将拉普拉斯函数替换为"IN1 IN2 1")、该模型现在似乎可以正常工作。 我已经附加了我正在使用的.lib。
e2e.ti.com/.../4705.ina283.lib
此致、
彼得