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[参考译文] RM46L852：DMA 时序

admin
Guru**** 2393415 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/859492/rm46l852-dma-timing

器件型号：RM46L852

我正在尝试弄清楚、一个 n 字节的 DMA 传输需要多长时间的 RM46。

我假设需要一些时钟来读取 DMA 源/目标地址、传输数据、然后更新寄存器。

1.您是否有任何与此相关的时间信息？

2.如果 CPU 内核和 DMA 试图访问内部存储器，谁会赢得仲裁？

Lars

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    TI__Guru**** 2393415 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    Lars、您好！

    DMA 以系统时钟(HCLK)运行、并支持高达64位的传输。 内部 RAM 在整个支持的频率范围内支持字节/半字/字和双字模式的单周期读取和写入访问。

  • 0
    TI__Guru**** 2393415 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    好的、但这并不能真正解答问题。
    DMA 请求标志发出了多少个时钟、直至传输开始？  
    DMA 传输完成了多少个时钟、直到可以为新的 DMA 传输提供服务？

    谁在内存仲裁中胜出？ DMA 或处理器？

    Lars

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    TI__Guru**** 2393415 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    Lars、您好！

    我没有 DMA 时序。 如果 没有其他 DMA 待处理、我估计的是 DMA 获取请求和 DMA 执行传输之间的2~3 HCLK 周期。

    DMA 通过 AXI 从器件接口从 TCM RAM 读取/写入数据。 TCM 端口可接收来自 LSU (CPU 加载/存储单元)、PFU (CPU 预取单元)和 AXI 从器件(DMA 等)的请求。 在大多数情况下、LSU 具有最高优先级、其次是 PFU、AXI 从器件具有最低优先级。 当一个较高优先级的器件访问一个 TCM 端口时、一个来自较低优先级器件的访问必须停止。