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[参考译文] TM4C1231H6PGE：是否有一个易于出现此勘误 GPIO#10的引脚？

admin
Guru**** 2328790 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/590635/tm4c1231h6pge-is-there-a-pin-that-is-prone-to-this-errata-gpio-10

器件型号：TM4C1231H6PGE
主题中讨论的其他器件：TM4C123

大家好、

我有疑问。

请参阅 TM4C123系列微型计算机的 GPIO#10勘误表。
是否有容易出现此勘误 GPIO#10的引脚？

与我的客户进行 ESD 测试时、仅在特定端口上出现与勘误 GPIO#10类似的症状。
此端口是否在内部连接到模拟外设、是否容易受到影响？

此致、
Maekawa

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    TI__Guru**** 2328790 points
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    GPIO#10的问题最初是在使用相同处理节点的不同器件上发现的。 此问题与 ESD 事件期间打开的 ESD 结构有关。 在另一个器件上、I/O 引脚与3.3V 电源引脚相邻、最容易受到影响。
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    TI__Guru**** 2328790 points
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    [引用 user="Bob Crosby"]最容易受到影响的3.3V 电源引脚旁边的 I/O 引脚。

    这场无休止的"战斗"(所有半企业都喜欢)没有任何令人厌恶的迹象。   在提高处理速度的同时、缩减后的"芯片内部"变得(甚至)更容易受到"ESD"的影响/易受攻击。

    也许感兴趣的是-在另一家(大型)半公司工作-我们注意到、"与3V3电源引脚最远的 I/O 引脚"证明是"最易受影响的"。   (我们认为这些"更长"的信号路径会产生较高的阻抗)  在您所举的实例中-由于"过流"、降低阻抗(通过最小的布线行程)是否可能导致 ESD 器件故障？

    这可能突出显示了在"板级"降低 ESD 水平的"价值"、并且不会(过于依赖) MCU 的保护电路(单独使用)来执行"重 ESD 吸收/提升！"

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    TI__Guru**** 2328790 points
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    您好、Bob、

    感谢你的答复。

    我将回答我的客户。

    此致、
    Maekawa
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    TI__Guru**** 2328790 points
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    大家好、CB1_MOBILE、

    感谢你的答复。

    此致、
    Maekawa
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    TI__Guru**** 2328790 points
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    大家好、上一页、

    我相信该供应商生产的是"抗 ESD 干扰的多通道"网络 IC。   我相信 Bob 会同意、"添加"脱离 MCU"(即外部) ESD 保护方法/器件-证明(到目前为止)是避免 ESD 损坏的最佳方法...