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[参考译文] TLV320AIC3100:MIC_PGA ADC增益输出

Guru**** 2360600 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/581366/tlv320aic3100-mic_pga-adc-gain-output

部件号:TLV320AIC3100

您好,

我们有一个电路,我们将编解码器与MEMS麦克风结合使用,如下所示。

我们现在遇到的问题是ADC输入的模拟增益(第1/reg 47页)显示 了一种奇怪的行为,我们也在评估模块上测试了这种行为。

下图显示了PGA寄存器从0逐渐增加到59,5dB。

放大的步长显示当例如将175dB更改为18dB时,下降6dB。 这些步骤都是相同的,多次更改以检查行为是否稳定。

对此有何想法?

Rgds

西蒙

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    您好,Simon,

    欢迎使用E2E,感谢您对我们产品的关注!

    能否提供寄存器配置? 这是为了更好地解决这个问题。

    此致,
    Luis Fernando Rodríguez ñ o S.
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    您好,  

    我从0-8页执行了注册表转储,我猜所有需要的注册表都在其中。

    e2e.ti.com/.../reg-dump.txt

    Rgds

    西蒙

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    您好,Simon,

    这似乎与时钟设置问题有关。 您是否还可以提供MCLK,BCLK和WCLK频率值?

    此致,
    Luis Fernando Rodríguez ñ o S.
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    您好,

    我希望这将很容易解决。 我尝试了不同的时钟设置,但似乎没有一个可以解决这个问题。
    MCLK = 1.2288万 MHz
    BCLK = 1024 MHz
    WCLK = 32kHz

    Rgds
    西蒙
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    您好,Simon,

    第0页/注册20 (ADC AOSR_VAL)似乎配置为AOSR = 256 (0000)。 您需要AOSR = 128。 是否可以将此寄存器配置为0x80? 这将正确配置AOSR值以获得32KHz采样率。

    如果问题仍然存在,请告诉我。

    此致,
    Luis Fernando Rodríguez ñ o S.
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    您好,

    我更改了AOSR注册表,但似乎没有帮助。 一旦我更改了寄存器,ADC输入的电流就会减少约40dB,这使得测量行为非常困难,但从我所看到的情况来看,在增益中仍有相同的步骤。

    我还想指出一个奇怪的地方,就是在初始化之后,我不能在第4页上为ADC设置过滤器,而且一旦我设置了时钟并启用ADC,所有过滤器寄存器都设置为0。 由于我们不使用它们,所以对我们来说不是问题,但可能存在某种连接。

    Rgds

    西蒙

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    所以,我要确保我仔细检查了我的时钟设置。 正如我之前所写的那样,AOSR不能解决我的增益问题,而且似乎会减弱我的信号。

    正如您所看到的,我们的行为与我在第一篇文章中所展示的行为相同。

    为了确保我在GPIO1引脚的多路复用上测量了编解码器中的时钟:

    分隔器 M 128.
    MCLK 96.1 12.3E+6.
    BCLK 8. 1.0E+6.
    DAC CLK 96.1 12.3E+6.
    DAC MOD CLK 32.2 4.1E+6.
    ADC CLK 96.1 12.3E+6.
    ADC模块CLK 32.2 4.1E+6.

    Rgds

    西蒙

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    您好,Simon,

    感谢您提供时钟设置。

    在过去的帖子中,您提到时钟值是:

    MCLK = 1.2288万 MHz
    BCLK = 1024 MHz
    WCLK = 32kHz

    这是否正确? 测量值似乎与这些值不相符。

    此外,您还需要确保遵守最大时钟频率。 在提供的值中,它们似乎不尊重时钟频率:

    www.ti.com/.../tlv320aic3100.pdf

    此致,
    Luis Fernando Rodríguez ñ o S.
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    您好,

    我认为测量值在 测量精度的公差范围内。 我将这些值放在表格中,以便更好地阅读。

    名称 已计算 已测量 限制
    MCLK 1.2288万 MHz 12,3MHz ≤110 MHz (CODEC CLKIN)
    BCLK 1024MHz 1MHz ≤14.3 MHz (根据3.4 数据表)
    DAC CLK 1.2288万 MHz 12,3MHz ≤49.152 MHz
    DAC MOD CLK 4,1MHz 4,1MHz 6.758 MHz
    ADC CLK 1.2288万 MHz 12,3MHz ≤49.152 MHz
    ADC模块CLK 4,1MHz 4,1MHz 6.758 MHz
    DAC_FS 32kHz 不适用 0192 MHz
    ADC_FS 32kHz 不适用 0192 MHz
    WCLK 32kHz 32kHz 不适用

    我希望这张表更容易理解,因为另一张表对我来说是更多笔记,但我认为它会有所帮助。

    Rgds

    西蒙

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    您好,Simon,

    问题似乎与AOSR值有关。 它被配置为256。 是否可以将第0页/注册20配置为0x80?

    此致,
    Luis Fernando Rodríguez ñ o S.
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    你(们)好  

    是的,我已经更改了AOSR,很遗憾,这不能解决我的ADC_PGA问题。 我们有一个-40dBm的输入,在寄存器设置中36dB的增益 是测量的4dB。 从36到59,5dB,寄存器曲线正确,可导致测得的最大增益28dB。 当AOSR 设置为0x80时,我们还会在8,8kHz时产生丑陋的噪音。 是否有一个初始化脚本可以在 32kHz时与TLV320DAC3100EVM配合使用? 我已经加载了二进制文件,但提供的“编解码器控制软件”似乎无法正确初始化编解码器。

    Rgds

    西蒙

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    您好,Simon,

    首先,我建议验证EVM是否配置为以32KHz的频率工作。 您可以使用WCLK进行验证。 WCLK频率必须为32KHz。

    然后,查看附加的脚本。 它包含32KHz采样速率的寄存器初始化。

    e2e.ti.com/.../Init_5F00_script.txt

    此致,
    Luis Fernando Rodríguez ñ o S.

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    您好,

    我检查了WCLK,我们有32kHz。不幸的是,您的脚本似乎不完整,因为ADC相关块未初始化。 我在运行脚本后手动设置相关注册,这会导致与我之前在帖子中提到的结果/问题相同的结果/问题。 能否提供32kHz ADC->I2S路径的初始化?  

    Rgds

    西蒙

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    您好,Simon,

    请查看随附的脚本。 它包含32 KHz的ADC -> I2S路径初始化。

    e2e.ti.com/.../Init_5F00_script_5F00_II.txt

    此致,
    Luis Fernando Rodríguez ñ o S.

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    您好,

    感谢您的快速回复。 我已经在EVM板上检查了它,它仍然具有相同的行为。 我必须为我们的设置更改三个寄存器,在这里我们将麦克风连接到MIC1RP。 更改的寄存器为Page 1/Reg 48: 0x20/Reg 49: 0x00。 我还必须调整模拟麦克风增益第1/Reg 47页:0x00-0x77。

    我对可能是什么原因的想法不多。 当我在EVM板上测试它时,它不应该是硬件问题,麦克风似乎可以提供足够强的信号。

    Rgds
    西蒙
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    您好,Simon,

    您是否可以尝试使用线路输入来测试EVM? 我的意思是,您能否进行测试,将来自PC耳机/线路输出的音频信号发送到EVM的MIC-IN输入? 我在EVM上以32KHz的采样速率测试了此测试,并且得到了正确的结果。

    请使用我为此测试提供的脚本,并告诉我您的结果。

    此致,
    Luis Fernando Rodríguez ñ o S.
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    您好,

    所以它似乎是在一个direkt信号源上工作的,这有点奇怪,但至少我现在知道在哪里看了。 我将尝试改进麦克风输入并检查偏置是否正常工作。

    感谢你的帮助

    Rgds

    西蒙