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[参考译文] DIX4192:读取DIR的状态寄存器时出现问题

Guru**** 2383240 points
Other Parts Discussed in Thread: DIX4192
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/649506/dix4192-problem-in-reading-status-register-of-dir

部件号:DIX4192

我使用的是DIX4192和带SPI接口的PSoC3芯片。 我使用 了PSoC Creator IDE的SPI组件(SPIM)。  

虽然我能够成功地写入芯片(通过 AES/EBU输入的锁定引脚指示为低电平),但我无法读取 DIR的状态寄存器(1,2和3)。 它每次都会产生不稳定的结果。  

有人能帮我快速解决吗?

此致。  

Arup

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    你好,Arup! 欢迎来到e2e

    我们将研究此问题 DIX4192,并将提供更新以解决此问题。 谢谢。

    此致,
    Ravi
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    您好,Arup,

    您能否在SPI读/写期间共享CS,CDIN,CDOUT和CCLK信号的波形?  

    我假设您遵循DS (9.4 .1节)中定义的SPI模式的主机接口操作。 波形有助于澄清断开。 谢谢。

    此致,
    Ravi

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    我正在严格遵循DS的9.4 1中所写的内容。 写入相应寄存器之前,最重要的位设置为Hi。 我可能很难向您发送波形。 而是要求您给我发送一个用于 读取状态寄存器的示例代码。

    此致。  

    Arup

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     请查找从示波器获得的SPI的CCLK和SS的附加波形。  我进一步观察到,只有 通过SPI读取命令读取DIR的状态调整器时,才会生成中断(通过DIX4192的INT行)。 我发现这是一个异常操作,因为 INT应该根据DIR输入流中存在的任何未屏蔽错误条件生成(我已使用0xf4配置了0x16寄存器)。 请详细说明发生这种情况的原因。

    此致。

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    解决我的问题需要多长时间? TI的任何人都能回答我的问题吗?  

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    您好,Arup,

    我休假时不在办公室,我们团队的大部分成员也不在,因此出现了延迟。  

    我将查看您提供的其他详细信息,并将提供更新。 谢谢。


    此致,
    Ravi

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    我已经提出了一个多月的问题,但至今仍未解决。 我不知道转至其他品牌是否更好? 这是我第一次使用TI。 我是Freescale,Cypress,Cirrus Logic,NXP,Silicon Lab, Xilinx 等 从未感到如此无助!  TI首次为我提供惊喜支持。 我现在可以得到一个总结性的答复吗?

    此致。