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[参考译文] TLV320AIC3104：具有48K采样率的THD+N问题

admin
Guru**** 2466550 points
Other Parts Discussed in Thread: TLV320AIC3104

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/760149/tlv320aic3104-thd-n-issue-with-48k-sample-rate

部件号：TLV320AIC3104

您好，团队，

我的客户使用不同的采样率测试TLV320AIC3104的THD+N比率。 他们发现具有48K采样率的THD+N的性能存在一些问题，当采样率为8K和16K时，这是正常的。

附件中的详细信息。 它具有SCH和测试结果。 客户使用不同的采样率设置寄存器，如我们的数据表和应用说明中所述。

您能否对此提供一些建议？ 谢谢！e2e.ti.com/.../THD.docx

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    TI__Guru**** 2466550 points
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    吴

    您能否提供48kHz的寄存器配置？

    此致，
    -Steve Wilson
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    TI__Guru**** 2466550 points
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    你好，Steve

    我应该提供哪种寄存器/寄存器配置？ 或者我应该向您提供所有寄存器配置吗？
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    TI__Guru**** 2466550 points
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    您好，
    最好使用完整的寄存器转储。 另外，您能否告诉我您是否正在测试EVM的性能？ 或者这是您自己的主板吗？

    此致，
    -Steve Wilson
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    TI__Guru**** 2466550 points
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    你(们)好

    当采样率为8k时，所有寄存器配置都引用 e2e.ti.com/.../3104_5F00_register_5F00_config_5F00_for_5F00_8K.txt

    当采样率为48K时，所有寄存器配置都引用 e2e.ti.com/.../3104_5F00_register_5F00_config_5F00_for_5F00_48K.txt

    我们正在测试我们自己的主板，而不是EVM主板

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    TI__Guru**** 2466550 points
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    你好，Steve

    这一问题是否有任何进展？ 希望收到您的答案，谢谢！

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    TI__Guru**** 2466550 points
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    嗨，Steve，

    您的建议如何？ 谢谢！

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    TI__Guru**** 2466550 points
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    吴

    您的设置不相似。 在8kHz寄存器配置中，您使用的PLL的MCLK大约为8.192MHz。 但是，在48kHz寄存器配置中，您使用的MCLK为12.288MHz。 对于这些设置，您需要使用不同的设置，这似乎很奇怪。 对于8k和16k，PLL或CLKDIV设置应与48kHz完全相同，唯一的差异是寄存器0x02的值

    您使用哪种MCLK频率？ 您的MCLK= 8.192Mhz是否可能？您只需对48kHz寄存器配置使用相同的PLL设置？

    此致，
    -Steve Wilson
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    TI__Guru**** 2466550 points
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    你好，Steve

    很抱歉，因为我们有中国春节假期，所以延迟回复您！

    根据您的建议，当采样率为48K时，我们将MCLK=8.192MHz设置为，问题仍然存在

    当   采样率为48K时，寄存器配置参考e2e.ti.com/.../3104_5F00_register_5F00_config_5F00_for_5F00_48K_5F00_new.txt

    当  采样率为8k时，寄存器配置参考e2e.ti.com/.../5618.3104_5F00_register_5F00_config_5F00_for_5F00_8K.txt

    根据数据表，寄存器0x02用于设置分频器，当配置不同的采样率时，寄存器值不相同

    我们是否可以在此工作模式下设置aic3104：音频传输到aic3104，然后 直接输出收集的音频数据 ！如果可以，我应该设置哪个寄存器？

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    TI__Guru**** 2466550 points
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    您好，

    您的配置是正确的，您能否提供8kHz I2S线的范围捕获？
    如果您提供AP设置，这也可能很有帮助。

    关于您的最后一个问题，AIC3104没有从ADC到DAC的内部路径。如果您不使用外部处理器，DOUT引脚可以与DIN引脚短路。

    此致，
    -Steve Wilson
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    TI__Guru**** 2466550 points
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    你好，Steve

    下图是我们的主板sch。SoC在I2S主模式下工作，而aic3104在 I2S从属模式下工作。

    MCLK由SoC生成，当采样率为48K时，MCLK必须为12.288MHz。 所以我们不能在8.192MHz中设置3104，当 48K时

    I2S标志指的是attachmente2e.ti.com/.../line_5F00_out.rar

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    TI__Guru**** 2466550 points
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    您好，

    原理图未通过，您能否再次尝试发布？

    关于您的I2S信号，您是否介意拍摄一张在同一屏幕上显示数据，WCLK和BCLK的图片？ 请触发WCLK。

    此致，
    -Steve Wilson
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    TI__Guru**** 2466550 points
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    吴
    我没有收到您的回复。您是否能够解决此问题？

    此致，
    -Steve Wilson