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你(们)好
我正在设计一个将 PCM9211用于 S/PDIF 输入和输出的设计。
我将为 XI 引脚提供24.576MHz 的时钟、为输入引脚 RXIN3提供合适的 S/PDIF 信号、并使用其 nRST 引脚上的低脉冲来复位芯片。
我有 IIC 连接、可以读取/写入寄存器、复位值如您的数据表中所述。
我已将寄存器0x34更改为0xC3以选择我的输入引脚(RXIN3)、所有其他寄存器保持其加电复位值。
我正在监控输出引脚 SCK0、BCK、LRCK 和 DOUT、希望看到输入的解码 I2S 版本。
时钟输出非常正确、如果我将 S/PDIF 发送器的采样率从44.1kHz 更改为192kHz、则会更改频率
但是_ DOUT 引脚没有数据输出。
我尝试将寄存器0x6B 更改为0x11、以避免汽车选择使我在切换到 ADC (我不使用该 ADC)时感到困惑。
寄存器0x38和0x39的读数都是0x00,这意味着输入的 S/PDIF 是“超出范围”,如果是,为什么时钟输出引脚跟踪我的 S/PDIF 发生器?
我希望您可以提出一些建议、以便我了解为什么我没有输出数据。
感谢你能抽出时间
此致
菲利普·J
您好 Phillip、
S/PDIF 将不输出到 DOUT,它将输出到 MPO0或 MPO1,正如它们在数据表第8.3.8.7.3节中所描述的那样,您可以在 第8.3.8.8节中看到有关引脚分配的更多信息。
此致、
Carson
低功耗音频应用
尊敬的卡森:
感谢您回答我的问题。
我可能解释得不太好、我使用的是 S/PDIF 接收器(DIR)、并期望解码的数据流从引脚 DOUT 流出。 这种布置可以在 TI 随 PCM9211 EVM 板提供的程序"CodecControl"中进行设置。 虽然我没有 EVM 板、但我使用了该程序来设置我所需的路由、并查看它会将内部寄存器设置为什么。 我希望下面的图片能够显示出来、很抱歉如果它是颠倒的、但我似乎无法让 Windows 10不这样做
不管怎样、它显示了我尝试进行分类的内容、但正如我最初说过的、如果我更改 S/PDIF 传输设备的采样率、时钟输出工作正常、并更改频率、但 DOUT 只是一个平坦的低电平(它应该是-10dBFS 1kHz 正弦波)。
寄存器0x38 (或0x39)中测得的采样率表明传入速率"超出范围"、但我尝试了48kHz、96kHz 和192kHz、结果相同。 如果输入信号“超出范围”,您是否希望芯片仍输出提取的时钟?
感谢你能抽出时间
菲利普·J
您好 Philip、
您是否确保在 PCM 通电之前遵守为其供电的 XTI 引脚时钟要求?
最棒的
Carson
好的、这是一个优点、由于时钟是由必须首先编程的 FPGA 供电、因此不会在稍后出现。 应用时钟后、芯片的 nRST 引脚上被复位、这是否有用?
“XTI 源时钟恢复后,FS 计算器恢复运行”这一行又会怎样呢?这不会建议在芯片上电后可以显示时钟? 如果不是,这条线实际上意味着什么?
这是否也会阻止数据流出现在 DOUT 引脚上?
此致
菲利普·J
是否可以在器件上电之前完全提供时钟?
"一旦 XTI 源时钟恢复、 FS 计算器恢复运行"这句话只是说如果时钟停止、然后您恢复运行、则操作将恢复、但这与在通电之前输入时钟没有直接关系、我认为这是您的问题、也是停止 DOUT 输出的问题。
-卡森
遗憾的是、当前设计无法实现这一点、因此我们必须废弃价值约2500美元的原型硬件。
我想建议、如果这是器件运行的一个重要方面、应该在数据表开头附近以粗体显示、而不仅仅是在第36页上以小注释的形式显示。
此致
菲利普·J
嗨、Philip、
我不能完全确定是什么阻止了您获得输出、让我联系过去负责此部件的工程师、了解可能的解决方法和/或实际导致问题的原因。 我不是 这部分的专家、因此我可能会错。
此致、
Carson
您好、卡森、谢谢。
如果芯片的设计工程师能提供任何建议、帮助我们挽救我们所构建的昂贵原型硬件、我将不胜感激。
我自己一直在使用 CodecControl 程序来查看是否有任何替代路由、我可以实现这些路由来将信号通过芯片并传输到我们的 FPGA、但到目前为止没有100%的路由
我注意到,在 EVM 板上,芯片使用晶振来传输 XTI 信号,我过去使用晶振时钟的经验是,在加电后,它们启动和稳定确实需要有限的时间-以任何方式使这种帮助消失?
此致
菲利普·J
您好、Philip、
我将复制并粘贴我从同事那里获得的直接信函。
尊敬的卡森:
XTI 时钟源不是操作所必需的,它仅供采样频率计算器使用,可用作 ADC 的时钟源。 唯一的问题是,如果 XTI 不稳定且不准确,PCM9211可能无法计算正确的采样率,但这实际上不会影响它解码时钟或数据的能力。 应用 XTI 后、计算器应恢复运行。 他们在提供 XTI 之后无法读取这一事实表明他们的输入存在问题。
您也可以让他们验证其 S/PDIF 输入是否在指定的逻辑电平内:
通常、来自同轴电缆连接的 S/PDIF 信号不在这些电平范围内、因为该协议仅要求最低0.2Vpp、最高0.6Vpp、这就是 RXIN0和 RXIN1上提供同轴放大器的原因。 PLL 可能锁定得足够好,因此频率是稳定的,但逻辑电平不能满足,因此不会对数据进行解码。
需要仔细检查的其他事项是 S/PDIF 的接地连接、并可能确保其电路板上有75欧姆的端接电阻。 他们可能希望探测电路板输入端的 S/PDIF 信号、以查看是否存在过度反射。
最棒的
Zak
如果这有助于解决您的问题、请查看并与我分享
此致、
Carson
大家好、感谢您提供的其他信息。 由于我们的设计中有一个连接到 RXIN3的光学输入器件、因此我已经对使用同轴 S/PDIF 的问题进行了旁路处理。 不过、我将仔细检查布局、以确保来自该器件的信号完整性良好。
我已经通过将 RXIN3路由至 RECOUT0、然后将 RECOUT0路由至引脚 MPO0来验证逻辑电平是否可接受、在这里、我有一个示波器测试点。
我还通过将 锁定信号路由到该引脚来检查 PLL,该引脚最初一直处于高电平(我认为这是指未锁定?)。 我使用寄存器0x40为所有功能断电/复位(0x33)、然后返回正常运行(0xc0)、之后锁定信号(如引脚 MPO0上所示)上升和下降、因此电路可能存在问题。
我将进一步调查
感谢您和您的同事的帮助
菲利普·J
你好 Phillip
没问题、当您有更多问题时、请告诉我。
以下是数据表中的一个小片段、介绍 PLL 是否锁定
祝你一切顺利、
Carson