[参考译文] TLV320AIC3106：reg 102/PAGE 0：PLL 时钟分频器 N 值

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器件型号：TLV320AIC3106
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感谢您的回复、

实际上，我还有一个关于寄存器102/PAGE 0的问题：D3：0位用于配置时钟分频器，但我不知道时钟生成路径中的位置，甚至不确定它是否真的存在...

在 TLVAIC3106数据表-第22页-图20 (音频时钟生成处理)中、PLL 路径中提到了固定的1/8分频器。

reg102/D3位：0是否以某种方式连接到此分频器？

问题是：我尝试了不同的值(即分频器)、但没有看到 FS 时钟的任何变化...

此致、

布鲁诺

0 admin 4 年多前

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您好 Bruno、

很棒的地方！对我来说、这肯定像是一个数据表错误。我看了 AIC3104数据表、因为这两个器件中的 PLL 非常相似(主要区别是在 AIC3106的 PLL 中使用 GPIO)、并且看到这些位保留在 AIC3104中。让我对这一点作出一些澄清。

此致、

Aaron

0 admin 4 年多前

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您好 Bruno、

我错了、这实际上根本不是数据表错误！该 N 值用于在 GPIO 1上生成 CLKOUT。这就是为什么在更改此值时、您没有看到 FS 发生变化的原因。请参见下图：

希望这对您有所帮助！

此致、

Aaron

0 admin 4 年多前

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非常感谢 Aaron、它确实对我们有所帮助...

此致、

布鲁诺

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