[参考译文] TAS5731M：TAS5731M 上电排序

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器件型号：TAS5731M
主题中讨论的其他器件：TAS5731

尊敬的 TI：

在数据表(2015年8月修订)中、我看到(必填？建议？) 10.2.1.2.4.1段中的初始化序列、其中基本说明 AVDD 必须在 PVDD 超过6V 之前至少保持100us 的"向上"状态。这表明我不能使用由 PVDD 电源供电的3.3V 降压转换器(为 AVDD 和 DVDD 供电)。

但是、在第11章中提到 AVDD/DVDD 和 PVDD 不需要上电排序。在这种情况下、我可以使用 PVDD 作为主电源、并从中获得3.3V 电压。这正是我喜欢的。

请解释我应如何阅读这些显然相互矛盾的段落。

与此相关、在 AVDD/DVDD 斜升时保持 SDA 和 SCL 为低电平的重要性如何(如10.2.1.2.4.1所建议)？或者更精确地说：在3.3V 斜升期间、我可以在这些线路上使用3.3V 的上拉电阻器吗？只有当3.3V 处于"运行"状态时、这些线路才会由处理器驱动。

期待您的回复。谢谢、

BERT Helleman

0 admin 6 年多前

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您好、BERT、

请按照 10.2.1.2.4.1中指定的初始化序列进行操作、如图69所示。时序/初始化序列由 IC 设计人员提供给我们、因此如果您不遵循正确的初始化序列、我们无法保证器件能够正常运行。

此致、

Luis

0 admin 6 年多前

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您好、Luis、

在10.2.1.2.4.1中、"all digital inputs"应该在 AVDD/DVDD 斜升期间为低电平。现在、我是否正确地假设：

*适用于 MCLK、LRCLK、SCLK、SDIN、RESETZ 和 PDNZ。

*这不适用于 PBTL 和 FAULTZ。

*这一点也不适用于 SCL 或 SDA (仅在其电源稳定后才需要打开 I2C 上拉电阻器是非常不常见的)。

当我出错时、请改正！

另一个问题：PVDD 的斜升速率是否有任何要求？

感谢您的帮助！此致、

BERT

PS、fyi：我在 PVDD = 24V 和 PBTL 模式下使用芯片。

0 admin 6 年多前

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您好、BERT、

"所有数字输入"引用了命令序列图中显示的那些内容、即 PDNZ、SDA、SCL、SDA 和 Resetz。在启动序列期间，这些值需要为低电平，否则您可能会在启动期间注意到一个弹出窗口。它不适用于其他未指定的数字输入信号。

如果电源为24V、则在导通后、电压为100uS 时电压的25%(6V)和110uS 时电压的33%(8V)。对于上升速率而言、这是主要要求。对于 TAS5731上的 PVDD、斜升速率可以更快。

此致、

Luis

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