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[参考译文] TAS6424E-Q1:关于上电序列

Guru**** 2362840 points
Other Parts Discussed in Thread: TAS6424E-Q1, TAS6584-Q1
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1483418/tas6424e-q1-about-power-on-sequence

器件型号:TAS6424E-Q1
Thread 中讨论的其他器件: TAS6584-Q1

工具与软件:

团队成员、您好!

请告诉我们。

在上电序列中、MCLK 在什么时间提供给 TAS6424E-Q1?

我们选择 TDM 模式来连接 MCLK 和 SCLK。

是否有任何特别的关注?

此致。

Kenji Gemma

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    Kenji,

    MCLK/SCLK、FSYNC 和 SDIN 可随时出现在器件中。  最好在3.3VDC 启动且/STANDBY 引脚被拉至高电平后、向器件提供 TDM 音频和时钟。   

    此致、
    Gregg Scott

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    Gregg-San、

    感谢您发送编修。

    因此、我们可以假设上电序列时序图像类似于 TAS6584-Q1数据表中的图?

    这是一个简单的问题。

    我们可以假设器件的系统时钟不是 MCLK、而是内置在其他地方吗?

    此致。

    Kenji Gemma

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    Kenji-San,

    上电序列比 TAS6584-Q1更简单、因为 TAS6424E-Q1没有 PD 引脚。  在其他方面、它是类似的。

    是的、在 MCLK 可用之前、我们为器件提供了内部时钟。  如果 MCLK 被移除、则有一个看门狗可以在 MCLK 和内部时钟之间无缝切换。

    此致、
    Gregg Scott

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    Gregg-San、

    感谢您的答复。

    我们了解。

    请告诉我们另外一件事。

    内部时钟的频率是多少?

    此致、

    Kenji Gemma

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    Kenji-San,

    没有内部时钟的规格。  它位于11MHz 和12MHz 之间。  您的设计无需了解这一点。

    此致、
    Gregg Scott

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    Gregg-San、

    感谢您的答复。

    感谢您了解更多信息、我们对此表示感谢。

    此致、

    Kenji Gemma