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[参考译文] TMS320F28P650DH：CLB 演示：为故障信号生成 2 个 SYSCLK 延迟、然后输入 TZ

admin
Guru**** 2805425 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1608949/tms320f28p650dh-clb-demo-generate-2-sysclk-delay-for-fault-signal-then-input-tz

器件型号： TMS320F28P650DH

尊敬的团队：

您能否帮助提供基于 F28P65 的以下演示：

通过 CLB 为故障信号 (GPIO) 生成 2 个 SYSCLK 延迟、然后输入到 TZ？

 

此致、

Zane

  • 0
    TI__Guru**** 2805425 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Zane：
    我能知道它的目的吗？ 因为在 IP 本身内部可能有更好的方法来做到这一点。  
    谢谢
    Praneeth

  • 0
    TI__Guru**** 2805425 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好 Praneeth、

    什么是 IP？ 因为我的客户使用 CMPSS 进行过流操作、但他们发现 CMPSS 很容易受到噪声的影响。 因此它们需要使用外部 FAULT 信号触发 TZ。 请帮助配置演示以延迟 2 SYSCLK 从而触发 TZ。 非常感谢！

    此致、

    Zane

  • 0
    TI__Guru**** 2805425 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Zane：
    我会在一天之内回复你。
    谢谢
    Praneeth