Other Parts Discussed in Thread: TMS320F28379D, C2000WARE
器件型号： C2000WARE
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在 TMS320F28379D 上使用 GPIO 输入的 CLB 死区实现
您好、
我正在 使用 示例 1–组合逻辑来开发 TI C2000 TMS320F28379D 的 CLB（可配置逻辑块）。 但是、我未使用 EPWM 输入、而是按如下方式配置了 GPIO：
GPIO 配置：
GPIO50→模式 0 控制→INPUTXBAR1
GPIO52→模式 1 控制→INPUTXBAR2
GPIO0 →CLB 输入 1→INPUTXBAR3
GPIO1 →CLB 输入 2→INPUTXBAR4
CLB XBAR 映射：
AUXSIG0→INPUTXBAR1
AUXSIG1→INPUTXBAR2
AUXSIG2→INPUTXBAR3
AUXSIG3→INPUTXBAR4
输出配置：
GPIO2→CLB 输出、通过：OUTPUT1XBAR→CLB1_OUT4
GPIO3→CLB 输出、通过：OUTPUT2XBAR→CLB1_OUT5
CLB 输入多路复用器设置
IN0 多路复用器→AUXSIG0
IN1 多路复用器→AUXSIG1
IN2 多路复用器→AUXSIG2
IN3 多路复用器→AUXSIG3
CLB 输出路由
OUT4→路由至 XBAR
OUT5→路由到 XBAR
我使用相同的 clb_config.c 和 clb_config.h 文件、并对输出 LUT 配置进行了少量修改、因为我使用的是输出 4 和 5。
电流行为
设置按预期运行：
*我给 gpio0 提供一个方波
*其反相信号被应用于 GPIO1
* CLB 使用 高电平有效逻辑正确处理逻辑 、我将在 GPIO2 和 GPIO3 上获得输出。
要求：
我想在互补 （相互逻辑对立） 输出之间实施一个死区（非重叠延迟）。
是否可以使用 CLB 计数器模块来实现死区？
或者 、是否有任何其他推荐方法可以在 CLB 内或不带 CLB 计数器块的情况下实现这一点？ 如果可能、请帮我解决该问题。
请参阅随附的图、了解我的预期：
这摘自 CLB 工具用户指南。
