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[参考译文] TMS320F2.8375万D:SDRAM突发接入

Guru**** 2331900 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/578733/tms320f28375d-sdram-burst-access

部件号:TMS320F2.8375万D

您好,

我有一个关于SDRAM暴冲访问的问题,想知道您是否可以帮助您深入了解下面的一些问题:

我的系统中已将SDRAM与Delfino DSP (EMIF1上的32位)连接。 我知道SDRAM具有脉冲访问模式,可以为大量连续访问节省访问时间。 在Delfino DMA设置中,有这种多脉冲传输方案。

我的问题:此DMA突发事件是否与SDRAM突发事件访问对应?

如果没有,是否有办法设置EMIF/DMA以启用SDRAM突发传输?

从我的测试结果来看,当前DMA/EMIF设置似乎不支持SDRAM暴冲访问。

使用DMA时,每次从内部RAM向SDRAM写入时平均有8个周期,每次从SDRAM读取时平均有16个周期。

这些访问周期编号是否合理?


感谢你的帮助。



  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好,

    [报价]我的问题:此DMA突发事件是否与SDRAM突发事件访问对应? [/引述]

    不,这是不同的。

    [报价]如果没有,是否有办法设置EMIF/DMA以启用SDRAM突发传输? [/引述]

    DMA没有突发访问。 它是装载和存储操作。

    [引述]

    从我的测试结果来看,当前DMA/EMIF设置似乎不支持SDRAM暴冲访问。

    使用DMA时,每次从内部RAM向SDRAM写入时平均有8个周期,每次从SDRAM读取时平均有16个周期。

    这些访问周期编号是否合理? [/引述]

    这看起来不错。

    此致,

    Vivek Singh

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    感谢Vivek的回复。 请详细说明,因为这非常重要。

    在SDRAM模式下Delfino的EMIF总线上,使用SDRAM:

    Delfino中的SDRAM控制器是否使用标准脉冲访问(SDRAM的标准功能)?

    还是在SDRAM模式下,EMIF上的Delfino每次访问都只有一个'word'(在本例中可能是32位宽)?

    我们希望能够更高效地将数据传输到SDRAM。

     

    如果Delfino上的EMIF总线上没有SDRAM的突发存取,您可以参考说明这一点的文档吗?

    如果是,您能否帮助我们了解如何使用标准突发式SDRAM访问?

    ‘D‘D它仅在特定模式下可用(如"直接"或"完全"),请帮助我们了解这些模式是什么。

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