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[参考译文] TMS320F28379D:将 EPWMCLKDIV 从 x1 (PLLSYSLCK 的/2)改为 x0 (PLLSYSCLK 的/1)后、EnDat 不工作

Guru**** 2610875 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1044495/tms320f28379d-endat-is-not-working-after-changing-epwmclkdiv-from-x1-2-of-pllsyslck-to-x0-1-of-pllsysclk

器件型号:TMS320F28379D

尊敬的工程师:

 我将使用28379D 测试 EnDat 接口。 我确认所有命令都运行良好。

但是、对于 我们的应用、我需要将 EPWMCLKDIV 从 x1 (PLLSYSLCK 的/2)更改为 x0 (PLLSYSCLK 的/1)。

在更改以下代码后、我尝试测试 EnDat 接口。

   SYSCTL_setEPWMClockDivider (SYSCTL_EPWMCLK_DIV_1);

并将 ENDAT_RUNTIME_FREQ_DIVIDER 和 ENDAT_INIT_FREQ_DIVIDER 更改为2倍、如下所示。

  #define ENDAT_RUNTIME_FREQ_DIVIDER  6*2.
  #define ENDAT_INIT_FREQ_DIVIDER        250*2.

我查看了 EnDat 时钟频率。 这与以前一样。

但发生了 CRC 错误。

如果您知道、请告诉我解决该问题的原因和方法。

此致、

Jeong (jjeon@glentek.com)

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    [引用 userid="462704" URL"~/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1044495/tms320f28379d-endat-is-not-working-after-changing-epwmclkdiv-from-x1-2-of-pllsyslck-to-x0-1-of-pllsysclk "]但是、对于 我们的应用、我需要将 EPWMCLKDIV 从 x1 (PLLSYSLCK 的/2)更改为 x0 (PLLSYSCLK 的/1)。[/quote

    此器件上的 ePWM 时钟(以及 CLB 时钟)限制为100MHz。  该器件是否以 SYSCLK > 100MHz 的频率运行?   

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    感谢您的回答。

    现在、SYSCLK 被设定为200MHz。

    让我再次尝试使用100MHz 的 SYSCLK 进行测试。

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    100MHz SYSCLK 的 EnDat 接口测试通过。  EPWMCLKDIV 被设定为 x0 (PLLSYSCLK 的/1)。

    我  有另一个问题。

    对于28388D、ePWM 时钟限制为200MHz。 CLB 时钟是否可以高达200MHz 使用?

    如果将 EnDat CLB 逻辑应用于具有200MHz 频率的28388D、是否可以正常工作?

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    对于 F28388D、CLB 可在计数器和 HLC 的管道模式开启的情况下以高达150MHz 的频率运行。    

    请参阅 此主题的答案

    谢谢

    Lori