您好专家、
我的客户正在帮助解决 F2838XD/S 或 F2837XD/s 问题、他们希望使用1个 C2000支持4-6 T 格式。
这两个系列中的任何芯片都能支持它吗?
根据我的理解、每种 T 格式都需要 CLB 逻辑块1、SPI 1、PWM 1、GPIO 3。
因此、对于 F2837X、最大值为3、只有3个 SPI。
对于 F2838X、最大值为4、只有4个 SPI。
我们还有其他限制吗、例如 CPU 负载?
BR
Emma
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您好专家、
我的客户正在帮助解决 F2838XD/S 或 F2837XD/s 问题、他们希望使用1个 C2000支持4-6 T 格式。
这两个系列中的任何芯片都能支持它吗?
根据我的理解、每种 T 格式都需要 CLB 逻辑块1、SPI 1、PWM 1、GPIO 3。
因此、对于 F2837X、最大值为3、只有3个 SPI。
对于 F2838X、最大值为4、只有4个 SPI。
我们还有其他限制吗、例如 CPU 负载?
BR
Emma
[引用用户="Emma Wang "]客户正在评估 F2838XD/S 或 F2837XD/s,他们希望使用1个 C2000支持4-6 T 格式。
[引用用户="Emma Wang "]据我了解、每种 T 格式都需要 CLB 逻辑块1、SPI 1、PWM 1、GPIO 3。
Emma、
是的、有一个澄清是正确的-我们仅将 PWM 用于其输出的启用/禁用功能及其与逻辑块的连接。 来自逻辑块的此输出可通过输出 XBAR 移至另一个器件输出。 (即 PWM 功能并未真正得到使用)。
对于我们的示例解决方案、器件上的 SPI 资源数量可能是限制因素。
对于 CPU -是的、解决方案需要运行软件来打包/解压缩消息并计算 CRC。 我目前没有对这个进行基准测试、但是提供了所有软件、可以对其进行试验、以确定它是否满足客户的要求。 例如、他们还可以根据系统的具体情况删除某些代码。
此致
Lori
Emma、
FSI -此协议具有基于帧的要求、与编码器接口协议不兼容。
SPI 模式下的 McBSP 应该工作。 这在所有器件上并不常见。 我们没有使用它的编码器接口示例、但我已经和几位同事讨论过这一点、我们看不到任何明显的问题
另一种可能是使用 CLB 类型2的消毒器功能。 但是、以这种方式替换 SPI 需要对 TI 参考设计进行一些重新构建、但这一点尚未得到充分考虑。 今天、这将由客户决定、因为我们没有可用的示例。
此致
Lori