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[参考译文] F28M36P63C2：DDSRF PLL

admin
Guru**** 2925550 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/976348/f28m36p63c2-ddsrf-pll

器件型号：F28M36P63C2

您好！

我将使用 DDSRF PLL 函数来估算电网角、并随后在逆变器的三相输出生成中使用该 θ。 我的三相输出的频率与电网频率 xy (60Hz)的频率相匹配。 但在原型的电网三相输出和三相输出之间存在40度的相位滞后。 可以通过调整 SOLAR/v1.2目录中 spll_coeff_compute.pdf 中指定的阻尼因子来固定该相位裕度吗？ 我们非常感谢您提出的任何想法或建议。

谢谢、

Srini.  

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    TI__Guru**** 2925550 points
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    40度相位滞后与预期不匹配、请注意、我们使用基于余弦的变换、因此 PLL 将锁定在 A 相电压的峰值处、您可能会看到、相移为90度、但由于所使用的变换、这是预期的。   

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    TI__Guru**** 2925550 points
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    感谢您抽出时间、Manish。 我不使用余弦斜坡信号函数作为我的电网基准、而是使用实际的三相电网电压作为基准。

    之前、我检测到相应逆变器输出(A、B 和 C)的电网测量(A、B 和 C)、并注意到相移接近30-40度。 我将测量移到了其他相位、并注意到、

    相移约为90度、

    电网参考 A 相-逆变器 C 相

    电网参考 B 相位-逆变器 A 相

    电网参考 C 相逆变器 B 相

    除了将三相逆变器输出的顺序从 A、B、C 定序更改为 A C、A、B、B、并添加90度相位滞后作为补偿来补偿移位之外、还有没有更灵活的解决方案可以让我去探索吗？

    谢谢、

    Srini.

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    TI__Guru**** 2925550 points
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    Srini,

    如果感应变换和驱动变换都基于余弦、则它们应匹配。

    看起来您的序列不匹配在 somwhere。  

    －Manish  

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    TI__Guru**** 2925550 points
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    Manish、  

    从所附的图像中可以看到、电网感应信号是正弦波形、从原型生成的三相输出是余弦。 红色波形是原型输出。 蓝色是电网输入。

    谢谢、

    Srini.

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    TI__Guru**** 2925550 points
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    在我看来，对于 abc->dq0和 dq0->abc 所用的转换，您有一些断开的情况，它们是否来自同一个库？  

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    TI__Guru**** 2925550 points
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    问题在于我的开环 Manish 的实现。 此问题已解决。 感谢你的帮助。

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    TI__Guru**** 2925550 points
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    很棒！ 感谢您的观看。