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[参考译文] TMS320F280049C:DriverLib PLL 配置延迟

Guru**** 2551110 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/948670/tms320f280049c-driverlib-pll-configuration-delay

器件型号:TMS320F280049C

在 DriverLib 文件 sysctl、.c 中、PLL 配置中添加了延迟。  TRM/Docs 中没有提及此延迟。

                   //

                   //关闭 PLL

                   //

                   EALLOW;

                   HWREGH (CLKCFG_BASE + SYSCTL_O_SYSPLLCTL1)&=

                       ~SYSCTL_SYSPLLCTL1_PLLEN;

 

                   SYSCTL_DELAY (3U);

 

                   //

                   //写入乘法器、自动打开 PLL

                   //

                   HWREGH (CLKCFG_BASE + SYSCTL_O_SYSPLLULT)= PLMULT;

此外、没有代码注释说明。  您能否提供有关此延迟的详细信息?

谢谢、

Eric

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Eric:

    PLL 断电信号通过时钟域交叉、因此通过路径中的同步器。 添加此延迟是为了考虑同步、以确保 PLL 在加电之前使用不同的 PLL 乘法器设置(这是下一条指令)断电。

    此致、

    Nirav