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[参考译文] TMS320F28375D：ADC VREF 引脚连接。

admin
Guru**** 2445440 points
Other Parts Discussed in Thread: TMS320F28375D, OPA350, OPA320

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/761559/tms320f28375d-adc-vref-pin-connections

器件型号：TMS320F28375D
主题中讨论的其他器件： OPA350、 OPA320

您好、团队 C2000、

参考(https://e2e.ti.com/support/amplifiers/f/14/p/761547/2814846#2814846 )。   TMS320F28375D TRM (http://www.ti.com/lit/ug/spruhm8g/spruhm8g.pdf )提供了一些驱动 ADC VREF 引脚的 WRT 建议。  建议从以下两种方式中驱动4x VREF 引脚：

1、单个基准连接到4个独立的 OPA350器件/封装。

2.连接到2个单独 OPA350器件/封装的单个基准连接到 VREFA/ C 和 VREFB/D

4倍 ADC/VREF 外设实现最佳/一致的性能。  问题..

1.从具有4个运算放大器的单个器件/封装或4个独立运算放大器的4个单独器件/封装中驱动 VREF 引脚是否更好/相同/更糟？

2.  从连接到单个运算放大器的单个基准驱动 VREF 引脚是否更好/相同/更差。 具有4x 过滤路径(请参阅 https://e2e.ti.com/support/amplifiers/f/14/p/761547/2814846#2814846 )？

谢谢、Merril

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    TI__Guru**** 2445440 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Newman、您好！

    与共享一个运算放大器通道的两个 VREF 相比(根据我们使用 OPA350和 OPA320的特性说明)、每个运算放大器通道的一个 VREF 在 SNR 和 THD 方面的性能稳定地略有提高、但显著提高。 因此、我们希望由单个运算放大器通道驱动的所有 VREF 的性能比每通道一个或两个 VREF 差得多。

    如果您确实更关心 ADC 到 ADC 增益误差匹配或具有显著的成本/面积限制、则使用单个运算放大器通道可能是合理的。

    请注意、如果每个运算放大器通道驱动多个 VREF、则可能需要选择稍高的缓冲电阻器(Ra、Rb、Rc、Rd)、以确保运算放大器的稳定性与 C2000 EVM 上的性能相比。 这是因为每个额外的滤波器电路都是运算放大器输出上的附加容性负载。
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    TI__Guru**** 2445440 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好 Devin、
    谢谢。。。 WRT“C2000 EVM 上的内容”.. 您指的是哪些特定的 EVM？

    图10-24的 TRM (www.ti.com/.../spruhm8g.pdf)中显示了 VREFA/C&VREFB/D 配对建议(而不是 VREFAA/B & VREFC/D 配对)、这是否有原因？

    您的评论是：“每个运算放大器通道的一个 VREF 在 SNR 和 THD 方面始终有小幅但显著的性能提升”。 我们期望看到“小而显著的性能提升”的幅度是多少？

    WRT“因此，我们希望由单个运算放大器通道驱动的所有 VREF 的性能比每通道一个或两个 VREF 差得多。” 我假设这是 WRT SNR 和 THD。 如果我们希望在4个 ADC 之间实现一致的性能、该怎么办？ 看起来是单个 VREF。 单个运算放大器和4个滤波器最适合这种情况吗？

    谢谢、Merril
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    TI__Guru**** 2445440 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Newman、您好！

    两种可能的 EVM 是 F2837xD Launchpad 和 F2837xD controlCARD。 这两种驱动电路都应具有类似的 VREFHI 驱动电路示例。

    配对选择基于器件上的引脚位置；A 和 C 在引脚排列中彼此靠近、B 和 D 也是如此

    通过分别驱动每个 VREFHI、典型 SINAD 在数据表上方增加了1dB-2dB (在16位分辨率模式下)。 我认为、这主要是由于 SNR 增加了大约相同的量、因为该器件上的 SINAD 由 SNR 性能决定。

    是的、这会影响交流规格(SNR、THD 等)。 您可以根据驱动运算放大器的 Vos 规格直接确定增大的 ADC 到 ADC 增益误差。 如果 Vos 规格低于器件数据表中的器件 ADC 到 ADC 增益误差、则在使用多个运算放大器时不会有明显的差异。