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https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/788395/tms320f28035-when-sci-transmit-fifo-is-empty-how-long-does-the-fifo-interrupt-actives
大家好
我正在，F28035 μ s 使能 SCI 发送 FIFO 中断(TXFFIENA=1)、并将 TXFFIL=0 (发送 FIFO 中断级别位)。
有时、当运行到发送 FIFO 中断 ISR 时、我没有收到要写入 TX FIFO 的数据(因此 TX FIFO 很长时间为空)、并且我发现 ISR 将持续激活(此模式适用于我)、 但我不知道 中断之间有多长时间处于活动状态？
此致
