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[参考译文] F28M35H52C:F28M35H52C ADC#39;s 电源异常

Guru**** 2535750 points
Other Parts Discussed in Thread: F28M35H52C

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/810318/f28m35h52c-f28m35h52c-adc-s-power-abnormal

器件型号:F28M35H52C

您好!

为 F28M35H52C 的 ADC 加电时 、外部高基准(ADC1VREFHI)和3.3V 模拟模块1电源引脚(VDDA)均加电。

外部高基准(ADC1VREFHI)由 LDO (5VA 至3.3Vref)供电。 3.3V 模拟模块1电源引脚(VDDA)由直流/直流(5VA 至3.3V)供电。

现在,当 VDDA 引脚的电压达到0时,5VA 会快速下拉(大约为3伏)。因此,上述现象会导致低于额定电压3.3Vref。

所以我的问题是 ,ADC1VREFHI 和 VDDA 是否有电,导致阻抗变化。谢谢。

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    Eric、

    根据您的帖子、我了解 VDDA 和 ADC1VREFHI 使用不同的直流转换器进行偏置。  不过,我不清楚以下几点:

    [引用 USER="Eric QI">现在当 VDDA 引脚的电压达到0时,5VA 会快速下拉(大约为3伏)。因此,上述现象会导致低于额定电压3.3Vref。[/QUOQ]这是与 VDDA 降至0V 的断电情况有关,还是拼写错误?  两个直流转换器都连接了单个5VDC 电源吗?  这个5VDC 共享压降是否降至3V?  5VDC 可以维持多少电流或功率?

    [引用 user="Eric QI">我的问题是 ,ADC1VREFHI 和 VDDA 是否具有电气功能,导致阻抗变化。您能否详细说明阻抗变化的含义?  VREFHI 上的有效负载应该没有变化-这是一个缓冲输入信号。  当 VREFHI > VDDA 或 VREFHI < VSSA 时、可能会激活 ESD 保护二极管。  VDDA 电流消耗可能会因 ADC 和比较器的工作状态而异。   

    如何处理其他器件电源?  IO 和 ADC 引脚在上电之前是否与外部电压隔离-数据表的"电源排序"部分对此进行了介绍。  是否满足数据表中的建议运行条件?

    Tommy

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    感谢你的答复。

        连接到两个直流转换器的单个5VDC 电源。例如、VDDA 的电源(3.3V)导致0伏、

    电源芯片(3.3V)焊接不良。 高于(3.3V 达到0伏)的现象会导致3.3Vref 和5V 电源异常。

    此外、 在正常运行期间、5V 的负载容量足够。

    在上电之前、MCU 的 IO 和 ADC 引脚不会与外部电压隔离。 IO 和 ADC 同时供电。

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    Eric、

    在我看来、您已经怀疑 VDDA 直流转换器导致了问题行为。  我不希望 MCU 引起此类问题。

    您是否正在寻找任何其他信息?

    Tommy

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    测试时、5V 电源由外部直流电源供电、正常运行时、VDD3V3和3V3REF 全部处于额定电平。

    现在、在上电之前、移除 U2。然后、为5V 电源、3V3REF 和5V 电压 瞬间低于正常值。

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    Eric、

    您可能已经尝试附加图像、但我无法看到它。  我假设这可能是原理图快照?  可以再试一次吗?

    当您说移除 U2时、您是否意味着对组件进行脱焊、使其不再在电路板上?

    Tommy

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    Romove U2完全意味着从电路板上脱焊。之后、3V3REF 和5V 会立即偏离额定值。

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    Eric、

    这张图对帮助我了解您的需求非常有用。

    如果移除 U2、则 VDDIO 和 VDDA 保持断电状态、而其他信号(如 VREFHI)保持断电状态。  这种情况违反了数据表中的建议:

    施加到非电源引脚的电压将偏置内部 ESD 保护二极管、以将电流分流到基准电源、多余的能量可能会激活寄生漏电路径(闩锁)。  最多可通过 ESD 保护二极管由 VDDIO 和 VDDA 电源加载 U3。

    Tommy

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    感谢你的帮助。

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    您好、被叫人

    再次感谢您提出有关 F28M35H52C 的问题。

    电压不应大于 VDDIO 之上的二极管压降(0.7V)

    施加到任何数字引脚(对于模拟引脚、该值比 VDDA 高0.7V)

    器件上电之前的状态。 施加到未上电引脚的电压

    器件会以意外的方式偏置内部 p-n 结并产生

    不可预测的结果。

    上面的文字在数据表中进行了解译。我想知道电路图

    验证。\n 您能提供一些帮助吗?

    谢谢。

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    Eric、

    理想情况下、外部信号和器件引脚之间应存在一定的隔离层(如晶体管)、以便在上电之前提供隔离。  这对于某些系统来说可能是不可能的、因此下一个最佳解决方案是将限流串联电阻器和低 VT 二极管(如肖特基二极管)相结合、以分流电源中的多余能量、这与外部 ESD 保护二极管非常相似。

    目标是限制电源未通电时通过信号引脚的能量。

    Tommy