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[参考译文] TMS320F28379D：F2837x controlCARD R1.3基准电压

admin
Guru**** 2126830 points
Other Parts Discussed in Thread: OPA4350, OPA350, REF2030
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/567681/tms320f28379d-f2837x-controlcard-r1-3-reference-voltage

器件型号：TMS320F28379D
主题中讨论的其他器件：OPA4350、 REF5030、 REF3030、 OPA350、 REF2030

您好！

我在数天内遇到了 F2837x controlCARD R1.3的 ADC 转换问题、我认为我们发现了问题的根源。 Wewere 无法使用 ADC 获得良好的转换。 我们始终看到多个具有相同值的样本。 通过绕过3.0V 电压基准(U12 REF5030)的所有运算放大器(U13 OPA4350)、转换结果看起来非常好。 您能否确认问题来自开发板上的运算放大器。 您还能解释一下我们为什么在电路板上使用放大器获得这种结果。  

链接至我以前的帖子：

此致

Dany

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    TI__Guru**** 2126830 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    这似乎是该帖子的延续： e2e.ti.com/.../566150

    尊敬的 Dany：

    这看起来更好、但看起来仍然不是很好。 输出似乎仍然有一些阶梯部分、它们比以前小。 您能否尝试以下操作：

    -生成转换值的直方图而不是时间序列？ 这样、您应该能够查看大代码块是否系统丢失、或者楼梯部分是否随机发生。 从上面的图中可以看出、这似乎是第一种情况-当信号上升时、下降信号的阶跃与同一位置的阶跃匹配-但直方图将更加确切。

    您得到的结果似乎表明 ADC 根本不起作用。 您配置的 SYSCLK、ADCCLK 和 S+H 持续时间是多少？ 您是否通过查看引脚上的 XCLKOUT 来确认了 SYSCLK？ 您是否已读回 ADCPRESCALE 和其他时钟寄存器以确认这些设置是否按预期写入？
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    TI__Guru**** 2126830 points
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    您好 Devin、

    感谢您的快速回答。 我们还注意到、阶梯部分似乎位于信号上的同一位置。 我们尝试了不同的 ADCCLK 和 S+H 持续时间、但我们没有注意到任何差异。 我们还看到、如果绕过运算放大器、ADC 的中量程是不同的。 采用原始配置时、中量程为 arround 2038、运算放大器旁路时、中量程为 arround 2047。

    我们项目的配置为：

    SYSCLK = 200MHz

    ADCCLK = 50MHz

    采样窗口= 100ns

    转换时间= 220ns

    我们将进行一些测试、以查看引脚上的 XCLKOUT 并读回 ADCPRESCALE 和其他时钟寄存器。

    您将找到随附的包含数据的 Excel 文件。

    e2e.ti.com/.../ADC-samples.xlsx

    此致

    Dany

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    TI__Guru**** 2126830 points
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    尊敬的 Dany：

    我强烈建议在运算放大器和旁路模式下使用 DMM 测量 VREF 电压。 这可能会在您的两个发行版中间考虑到这种变化。

    您可以尝试的另一件事是绕过 REF3030、但不绕过 OPA350。 为此、移除 R60并在 V1.3 controlCARD 上填充 R59。 然后、您可以通过 ADC-VREFHI 引脚提供 VREF 电压。

    您能否确认 SW2和 SW3已配置为 OPA350的 VREFHI、而不是选择 VDDA？
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    TI__Guru**** 2126830 points
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    您好 Devin、

    我们在两种模式下测量了 VREF、电压相同、只有转换结果不同(使用 opmap 时为2038、使用旁路运算放大器时为2047)。

    我们还尝试移除 R60并使用相同的奇怪结果(阶梯)填充 R59 (VREF 由 REF5030提供)。

    我们再次尝试了这两种配置(SW2-SW3全部打开和全部关闭)、这就是我们能够看到使用 VDDA 配置 VREFHI 时问题不太明显的方法。 这样、我们就可以绕过 OPA4350、以查看基准电压为3.0V 的结果。 这就是我们获得更好结果的方式。

    此致

    Dany
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    TI__Guru**** 2126830 points
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    尊敬的 Dany：

    Agilent 33220A 的设置是什么？  信号在被驱动进入 ADC 前是否显著增益或减(例如系数10或以上)？

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    TI__Guru**** 2126830 points
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    您好 Devin、

    下面是我的测试设置：

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    TI__Guru**** 2126830 points
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    您好 Devin、

    我生成了一个直方图、正如您说过的、即使绕过运算放大器、我们仍然有一些阶梯部分。 您是否能够再现开发板的问题？

    Dany

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    TI__Guru**** 2126830 points
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    尊敬的 Dany：

    我要求直方图和增益的原因是、我想知道 Agilent 33220A 的分辨率是否会影响结果(该仪器使用14位 DAC 来生成信号)。 如果输入信号幅值较大、然后信号被放大到 ADC 范围、或者如果输入幅值真的很小且放大、那么您可能会在楼梯中看到 DAC 的分辨率。 为什么绕过基准也很有意义；您可以有效地向输入端添加噪声、这有助于将噪声传播出去并隐藏分辨率问题。

    不过、看看您的图表、分辨率不应成为问题； 您从1V 的合理信号振幅开始、然后将其下调、这应该会提高有效分辨率(输入信号0VDC + 1Vpp、如果它具有巨大的直流偏移、可能会是一个问题？)。

    您至少可以通过直接向 ADC 提供63.5mVpp 信号并查看该信号是否看起来正常或是否仍然有缺失的代码来排除此问题。

    我不确定在接下来的几天内是否有机会使用 controlCARD 进行此测试、但我们的内部特性评估板具有相同的 OPA350 VREFHI 驱动器电路、运行良好。
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    TI__Guru**** 2126830 points
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    您好 Devin、

    再次感谢您的帮助。

    如前所述、Agilent 输入信号为0VDC + 1Vpp。 在 ADC 上、信号为63.5mVpp、偏移量为1.5V、由 REF2030生成。 我们已经尝试使用相同的结果直接向 ADC 提供63.5Vpp 信号(电压基准通过 OPA350进行缓冲)。

    您是否认为有方法可以改善信号转换？ 我仍然不知道为什么 OPA350会对转换后的信号产生这种影响？

    Dany
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    TI__Guru**** 2126830 points
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    尊敬的 Dany：

    很抱歉耽误你的时间。 我能够在 R1.3 controlCARD 上重现此问题。 这可以通过将 R51-R54替换为0.1欧姆电阻器来解决(这是 BOM 和原理图中所要求的、但似乎是用100M 制造的)。 使用0欧姆电阻器或仅使用电阻器焊盘之间的焊桥也可能会提高性能。