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[参考译文] TMS320F28377D：PLL 输入是否可以是连接到 X1的单端时钟？

admin
Guru**** 2589280 points
Other Parts Discussed in Thread: CONTROLSUITE, C2000WARE

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/665064/tms320f28377d-can-pll-input-be-single-ended-clock-connected-to-x1

器件型号：TMS320F28377D
Thread 中讨论的其他器件：controlSUITE、 C2000WARE

发现器件数据表 SPRS880H–2013年12月–2017年7月修订版与外设驱动程序库用户指南 F2837xD-DRL-UG-210 2016年11月之间存在潜在矛盾的信息。  DRL-UG 的第5节系统控制第47页：
"该器件可由四个源之一计时：外部振荡器、两个内部振荡器中的一个或外部单端时钟源。 主 PLL 可与三个振荡器中的任何一个一起用作其输入、但外部单端时钟源除外。"

 "外部单端时钟源"是指连接到 X1 (X2未连接)的单端时钟、还是指 AUXCLK？  从数据表中摘录的以下内容并不表示 X1的单端输入不能是主 PLL 输入。

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    TI__Guru**** 2589280 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好 Susan、

    它指的是两者。 如图所示、X1可由谐振器、晶体和单端时钟提供。 另一方面、AUXCLK 只能由单端时钟供源。
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    TI__Guru**** 2589280 points
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    Susan、

    再澄清一个问题。 我看到混乱的来源。 系统 PLL/主 PLL 可从 X1单端计时。 AUXCLKIN 不会进入主 PLL、因为它有自己的 AUXPLL。 我将发送更新 DRL-UG 的请求。
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    TI__Guru**** 2589280 points
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    Susan、

    F2837xD-DRL-UG 来自 controlSUITE、由于 controlSUITE 正在逐步淘汰、因此不会再对该文档进行任何更新。 不过、您可以在 C2000Ware 中找到与 F2837xD_DriverLib_Users_Guide 等效的更新文档。 我已查看了 SYSCTL 模块章节、但未找到相关的措辞。 但是，如果你在新文件中发现了不一致之处，请提请我们注意。 谢谢。
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    TI__Guru**** 2589280 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    谢谢-感谢您提醒我们切换到 C2000Ware。 现在就着手进行工作、以便我能够为新项目提供最新的起点。