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[参考译文] TMS320F28388D:尝试了解以太网 MAC 控制器的操作

Guru**** 2549850 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1279817/tms320f28388d-try-to-understand-the-operation-for-ethernet-mac-controller

器件型号:TMS320F28388D

尊敬的 BU 专家:  

我是在尝试了解 EMAC 外设的操作、参考资料是 TRM。 请查看下图、这是我对 EMAC 操作流程图的理解。  

据我了解、包数据缓冲存储在系统内存中、DMA 的操作配置按应用写入描述符中。 DMA 根据其配置和描述符信息运行。

具体来说、有 Rx 队列/通道和 Tx 队列/通道的概念。 我不确定是 MAC 控制器内部还是 DMA 控制器中的机制。 很难理解队列/通道的含义及其仲裁优先级。 而且不了解突发传输的含义、突发传输的单位是什么? 字节还是数据包? 您能帮助说明此器件的操作吗?  

在 Rx path 中、我看到了 TRM 描述中的 Rx FIFO。 我猜是在 Rx FIFO 的基础上扩展 MAC 内核吗? 因此、接收到的数据包将首先存储到 FIFO 中、然后在 Rx DMA 获得优先级后、传输到 Rx 缓冲器。 我的理解是否正确?  

非常感谢、请提供 MAC 控制的详细操作说明。  

此致、  

将会  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    将、  

    我们将在几天后回复您关于此查询的问题。

    此致

    西达尔特

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    尊敬的 Siddharth:  

    以下是我对 EMAC 外设的新理解、是否正确、我想与您确认一下:  

    1)。 只有2个 DMA 通道、但没有4个;  

    2)。 每个 DMA 通道都可以在 Rx 或 Tx 方向工作、它是双向的。 如果 Rx 请求和 Tx 请求同时到达、DMA 通道将根据固定优先级或加权循环优先级方案进行仲裁。  

    3)。 当2个 DMA 通道同时接收到传输请求(无论它是 Rx 还是 Tx)时、可以选择3种仲裁方案:固定 优先级方案、WSP 和加权循环。  

    4)。 在 Rx 路径中、我们可以设置从 MAC 到队列的路由以及从队列到 Rx DMA 通道的路由。 我的问题是系统中有多少 Rx FIFO? 如果只有一个 FIFO、队列如何对应于 Rx FIFO 的内容?  

    此致、  

    将会   

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    将会、  

    您的理解是正确的、   

    对于第四点、 EMAC 支持两个 Rx 队列。 Rx FIFO 大小和 Tx FIFO 大小在 MAC_HW_Feature1寄存器中指定。 根据 TRM、它为4096字节。   MTL_RxQ0_ROS 寄存器中的 Operation_Mode 位用于 指示 所分配接收队列的大小、单位为256字节的块。

    此致

    西达尔特

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    尊敬的 Siddharth:  

    感谢您的解释。  现在我更清楚了。  

    此致、  

    将会  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    将会  

    感谢您的确认。 将关闭该主题。

    此致

    西达尔特

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    尊敬的 Siddharth:  

    另一个问题:在形成如下单播数据包时、前6个字节是目标地址、我想向您确认字节7和字节8是否是 MAC 帧中的类型/长度段?  

    此致!  

    将会