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[参考译文] CDCE6.2002万：CDCE6.2002万

admin
Guru**** 2562120 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/568934/cdce62002-cdce62002

部件号：CDCE6.2002万

您好，

我正在使用CDCE6.2002万。  我正在尝试更改已在生产中的电路板的循环BW。 我的目标是选择一个BW，它可以过滤来自嘈杂参考时钟(>1PS rms)的抖动，但也能够跟踪输入参考时钟上的一些调制(~1kHz)，而不会导致循环打滑或类似的锁定丢失问题。

我的当前带宽为20kHz (ICP-3mA，PFD = 31.25Mhz，VCO=2GHz)

我的固定约束是：

输入时钟：LVDS 250MHz

输出时钟：LVDS 250MHz

C1 33nf
C2 1uf

R2 39.

目标BW介于80kHz至100kHz之间。 当我尝试使用EVM软件时，我无法找到满足此所需带宽并满足Gamma Optimization和T3/T1比率的结果。 你能告诉我，在固定的限制条件下，CDCE6.2002万是否能够生产这种生物武器吗？

谢谢！

Chris

  • 0
    TI__Guru**** 2562120 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好Chris，

    通常，增加充电泵电流，最小化回路滤波器组件和减少总PLL N将帮助您设计更宽的回路带宽....

    通过将LFRCSEL更改为0x0F (R3 = 5k，C3 = 38 pF，使用3.75 mA充电泵)，我能够增加到24.5 kHz环路带宽。

    遗憾的是，最大相位检测器频率为40 MHz，否则您可以设置PLLR=6并重新编程PLLN=24 (假设预分频器= 2)，这将导致相同的2000 MHz VCO频率，但N更小，有助于增加环路带宽... 我可以获得32 kHz的LBW，LFRCSEL = 0x0F。 但再次强调，这是不符合规格的操作，所以我不推荐它。

    73岁
    Timothy
  • 0
    TI__Guru**** 2562120 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    感谢您的试用。 我找到了一个可产生114kHz BW的解决方案。 问题是伽马优化和T3/T1比率都略超出范围，但我发现EVM版本1.2 (我正在使用的版本)往往会错误地报告此比率。 我会附上EVM软件文件供您导入，但我在此处看不到附件的位置。 当然，它只是一个文本文件，因此您可以使用这些设置创建自己的.ini文件来进行评估

    jist为输入：=250MHz，输出：=250MHz，PFD = 10.417MHz，VCO=2000MHz

    寄存器
    052260550
    1878 878B6171
    200000002

    端口
    0日
    1 FF
    2 DF
    3 F9.

    输入
    PRI 250
    AUX 25

    外部组件
    C41000N
    R4 39.
    C5 33n

    谢谢！

    Chris