[参考译文] LMK04832：寄存器设置

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1116774/lmk04832-register-setting

器件型号：LMK04832

大家好、团队、

下面我对 LMK04832寄存器设置有疑问。请帮助回答以下问题？

即使我们使用分频器路径、也可以通过0x102寄存器(DCLKX_Y_DDLY_PD)将器件时钟数字延迟功能断电吗？
在0x103寄存器的 DCLKX_Y_DCC 说明中、启用占空比校正时、显示"半步进所需"。这是否意味着在 DCLKX_Y_HS=0 (无相位调整模式)的情况下会导致0.5clk 延迟？如果我们设置 DCLKX_Y_HS=1、则该0.5clk 延迟将被纠正、并且最终不会有延迟？
关于0x173寄存器、表5和表78之间的位[4]上有不同的默认值信息。哪一项是正确的信息？
在 POR 之后、应在每个寄存器中写入默认值。因此、在对器件进行编程时、用户是否可以仅访问需要写入的寄存器？还是最好访问/写入所有寄存器？
数据表建议以0x000到0x555的数字顺序对寄存器进行编程、PLL2相关寄存器编程除外。但是、EVM 源代码似乎是按照 R386 -> R387 -> R358 -> R359 -> R360 -> R1365的顺序设置的。寄存器编程序列是否有任何意义？

此致、

3 年多前

0 admin 3 年多前

TI__Guru**** 2542520 points

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您好！

请参阅以下答案：

1.是的、数字延迟部分与分频器无关、可通过 DCLKX_Y_DDLY_PD 位单独禁用。

2. 如果 DCLKX_Y_HS_=1、它将时钟相位调整半个时钟周期、并使用 DCLKX_Y_DCC=1、它将进行占空比校正。因此、如果希望进行占空比校正、则两个位都应处于高电平。

表5需要使用0x173[4]进行更正-> 1.

4.在开始位置位后、您只能访问/写入必要的寄存器。与 POR 一样、它会设置所有其他寄存器。

如数据表第8.5.1节的注释所述、在对其他 PLL2分频器进行编程后、必须对 PL2L2N 寄存器进行编程、以确保正确的 VCO 频率校准。因此、在 R387之前、VCO 频率经过校准、并在写入 PLL2_N 值(R358、R359和 R360)之后进行校准。

谢谢！

此致、
Ajeet Pal

0 admin 3 年多前

TI__Guru**** 2542520 points

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您好、Ajeet-San、

感谢您的评论。

[~ userid="256990" url="支持/时钟计时组/时钟和计时/f/clock-timing-forum/1116774/lmk04832-register-setting/4140500#4140500"]2. 如果 DCLKX_Y_HS=1、它将时钟相位调整半个时钟周期、并使用 DCLKX_Y_DCC=1、它将进行占空比校正。因此、如果要进行占空比校正、两个位都应处于高电平。[/QUERP]

如果我们设置 DCLKX_Y_DCC=1和 DCLKX_Y_HS=0、会怎么样？在这种情况下、占空比未校正？

此致、

0 admin 3 年多前

TI__Guru**** 2542520 points

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您好、Ajeet-San、

感谢您的支持。但是、我不理解 DCLKX_Y_DCC 和 DCLKX_Y_HS 的关系。您能否告诉我、当我们设置 DCLKX_Y_DCC=1和 DCLKX_Y_HS=0时、会发生什么情况？占空比校正与 DCLKX_Y_DCC=1和 DCLKX_Y_HS=1的条件有何不同？

此致、

0 admin 3 年多前

TI__Guru**** 2542520 points

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您好、Ajeet-San、

您可以支持此附加问题吗？

此致、

0 admin 3 年多前

TI__Guru**** 2542520 points

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您好、Ajeet-San、

您能告诉我何时可以提供评论吗？

此致、

0 admin 3 年多前

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尊敬的 Sato-San：

很抱歉耽误您的回答。

需要进行半时钟相位调整 DCLKX_Y_DCC=1和 DCLKX_Y_HS_=1、它还将提供占空比校正、其中 DCLKX_Y_DCC=1和 DCLKX_Y_HS=0提供占空比校正、但不提供半时钟周期相位调整。

谢谢！

此致、

Ajeet Pal

时钟和时序（参考译文帖）

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