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[参考译文] LMH1983:自由运行和计时的寄存器设置

Guru**** 2448360 points
Other Parts Discussed in Thread: LMH1983, LMH1981

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/919949/lmh1983-register-settings-for-free-run-and-genlock

器件型号:LMH1983
主题中讨论的其他器件: LMH1981

你(们)好

我们将数据表中的图22作为 genlock 模式的典型应用、并设计了一个定制板。
LMH1981的时序信号(H/V/F)通过 FPGA 进行一次缓冲、然后进入 LMH1983。
这是因为我们假设选择自由运行模式(没有来自 FPGA 的输入时序信号)或 genlock 模式(具有来自 FPGA 的 H/V/F 信号)。

然后、我们有一些问题。

当我们将 LMH1983作为自由运行模式工作时、我们必须做的是设置寄存器、如表13吗?
2. NO_LOCK 在自由运行模式下何时生效?
3.是否可以使用同一电路将自由运行模式更改为 genlock 模式?
4.如果问题3的答案是肯定的,那么将寄存器设置从表8更改为表13是否足够?
5.如果问题3的答案是肯定的,是否有一个建议的序列来改变每种模式的寄存器设置?

贝斯特雷加兹

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    你(们)好。

    我们将于下周一再次与您取得合作。

    此致、
    Hao

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    你(们)好

    感谢你的答复。
    我很期待收到您的回复。

    贝斯特雷加兹
    隐藏

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    您好!  

    是的、为了将器件置于自由运行模式、表13是需要遵循的正确寄存器设置。  

    自由运行模式意味着 PLL1是开环的、这与没有任何基准输入的锁相模式类似。  因此自由运行模式不应影响锁定时间。 由于 PLL1具有最小的环路带宽、当 PLL1锁定时 NO_LOCK 将置为有效。  

    我将再次检查从自由运行模式切换到 genlock、并将告知您。  

    谢谢、此致、Amin  

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    你(们)好

    感谢你的答复。

    >自由运行模式意味着 PLL1是开环模式,与没有任何基准输入的锁相模式类似。  因此自由运行模式不应>影响锁定时间。 由于 PLL1具有最小的环路带宽、当 PLL1锁定时 NO_LOCK 将置为有效。  

    我看到了数据表的图13。  它显示了 no_lock 反应的时序。
    当失去基准时、NO_LOCK 将为低电平(=LOCK?) 4.4s 之后。
    这是否意味着该器件可以为用户(或外部器件)提供锁定信号、即使在自由运行模式下也能通知锁定事件?

    >我将仔细检查从自由运行模式切换到 genlock 模式的情况,并将通知您。  
    感谢您的合作。  我期待您提供相关信息。

    贝斯特雷加兹
    不适用

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    你(们)好

    我对数据表中的以下说明还有其他问题。

    "当发生 genlock 期间的基准丢失时、PLL1可默认为自由运行或保持运行"

    这是否意味着当器件被切换到自由运行模式或保持模式时、在 genlock 模式下运行时必须发生基准丢失?

    如果在启动时未在 genlock 模式下应用输入基准、我想知道器件会正常工作。

    贝斯特雷加兹
    不适用

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    您好!  

    对我先前的回答进行了一些更正。  

    1. 写入寄存器0x05[4:3]即可选择自由运行模式或 genlock 模式。
    2. 在自由运行模式下、NO_LOCK 引脚应处于高电平。 由于在自由运行模式下、没有基准信号。  
    3. 即使通过设置0x05[4:3]= 01'b 将 PLL1配置为 genlock 模式、如果基准条件丢失、PLL1也将进入自由运行模式。  对于这两种运行模式、PLL1环路滤波器可以相同。
    4. 只需注册器0x05[4:3]即可在自由运行模式和 genlock 模式之间手动切换。
    5. 由于寄存器0x05是每个应答4需要写入的唯一寄存器、因此没有特定的序列。

    此致、  

    Amin

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    你(们)好

    感谢你的答复。
    我想安排我的问题以避免给您带来不便。

    首先、我的问题1至5将用您的最新答案进行清除。
    我知道寄存器设置为0x05[4:3]= 01'b 的器件基本上可以在 genlock 中工作、并在失去参考时进入自由运行。

    以下是其他问题。

    6.在答案3中,您提到在自由运行模式下,NO_LOCK 引脚应该为高电平。
    在图3中、在默认设置下、no_lock 在4.4s 后变为低电平。
    图3是否表示除在自由运行模式下之外的 NO_LOCK 反应?



    7. 您提到了我们需要选择自由运行模式或 genlock 模式的内容是写入 reg:0x05[4:3:]。
    LOR 模式寄存器(0x05[2])与失去基准时的自由运行操作无关吗?
    因为 LOR 模式寄存器的默认设置为0 (=LOR 上的保持)。

    8。如果我们设置0x05[4:3]= 01'b、PLL1将配置为 genlock 模式。
    我知道、如果在 genlock 操作期间发生基准丢失、器件将进入自由运行模式。
    但是、我不确定没有基准的器件能否从一开始就进入自由运行模式。
    在这种情况下、是否可以输入自由运行?

    贝斯特雷加兹
    不适用

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    如果您能回答我的问题、我将不胜感激。

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    您好!  

    NO_LOCK 本质上是一个在热锁模式下工作的状态引脚。 因为它需要设置一个基准输入(和其他寄存器)来确定 PLL 状态(锁定或不锁定)。 因此、对于自由运行、没有基准、它将保持高电平。

    7. LOR 模式寄存器确定当参考消失时器件是进入保持模式还是自由运行模式(显然是配置为锁相模式)  

    8.如果您处于 genlock 模式,但没有可用的基准,设备将进入保持模式或自由运行模式。  

    注意保持操作需要特定设置、请查看数据表第8.4.4节

    谢谢、此致、

    Amin

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    你(们)好

    感谢你的答复。

    >6.
    好的。 我明白了。

    >7.
    好的。 我知道、当 失去参考时、我应该设置0x05[2]=1以用于自由运行。

    >8.
    我想设置为 genlock 模式、但器件将处于默认状态。   
    因此、寄存器0x05[2]将为"0"、这意味着 LOR 上的保持。
    根据保持模式的说明、如果基准丢失、则有一个 A/D—D/A 对能够接管 PLL 控制环路并保持 VCXO 控制电压恒定。

    但是、如果器件一开始就没有输入基准、PLL1将永远不会被锁定、D/A 将无法保持 VCXO 控制电压。
    因此、保持模式似乎并不是一种从一开始就没有基准的情况。
    如果一开始就应该没有输入基准、那么我认为至少应该将0x05[2]设置为1 (自由运行模式)。

    我的理解是否正确?

    贝斯特雷加兹
    不适用

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    你好,Na,

    关于您对问题8的反馈、数据表第29页的寄存器0x16和0x17包含 VC_HOLD 值。  由 DAC 在保持模式下设置的保持值。  MSB、0x16上电复位值为二进制10。  寄存器0x17中的 LSB 未定义。  这表示从开始的保持模式可能是预期的情况、但我希望 LSB 默认为0x00。  给定我在数据表中看到的结果、在 LSB 未定义的情况下、值的范围可以是512到1023。

    但是、当您声明-如果您想要具体控制电压、则对于自由运行模式、0x05[2]= 1将允许您使用寄存器0x18和0x19更准确地设置电压。  默认为0x1ff = 511。

    73、
    Timothy

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    你(们)好

    感谢你的答复。

    您能否告诉我如何将0x18和0x19的值解释为实际的控制电压?
     0x1ff = 511 =>? 五

    贝斯特雷加兹

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    你好,Na,

    DAC 电压是一个10位数字、因此我希望编程0接近0V、而1023 clost 接近 Vdd。  我无法确认。  不过、请注意、DAC 输出范围指定为与电源轨的0.5V 电压、因此我不会在极端条件下预期0V 或 Vdd。

    73、
    Timothy

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    你(们)好  

    感谢你的答复。
    我明白了。

    贝斯特雷加兹
    不适用